[发明专利]打包数据对齐加计算指令、处理器、方法和系统在审
| 申请号： | 202210154160.6 | 申请日： | 2016-05-09 |
| 公开（公告）号： | CN114816523A | 公开（公告）日： | 2022-07-29 |
| 发明（设计）人： | E·J·范达伦;A·奥古斯泰恩;M·C·韦策伦伯格;S·罗斯 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 付曼;刘春元 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种处理器包含解码单元，其用来对打包数据对齐加计算指令解码。该指令要指示一个或多个源打包数据操作数的第一集、一个或多个源打包数据操作数的第二集、至少一个数据元素偏移，该第一集要包含第一数据元素，该第二集将包含第二数据元素。运行单元响应于指令要存储结果打包数据操作数，其要包含结果数据元素，各具有利用一对的源打包数据操作数的第一集的数据元素和源打包数据操作数的第二集的数据元素执行的运算的值。运行单元要将至少一个数据元素偏移应用于源打包数据操作数的第一和第二集中的至少对应一个。至少一个数据元素偏移要抵消源打包数据操作数的第一和第二集中每对的数据元素之间的对应的任何缺乏。 | ||
| 搜索关键词： | 打包 数据 对齐 计算 指令 处理器 方法 系统 | ||
【主权项】：
暂无信息
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