[发明专利]一种双时钟多核嵌入式并发时序仿真方法及装置在审
| 申请号： | 202211013460.9 | 申请日： | 2022-08-23 |
| 公开（公告）号： | CN115496016A | 公开（公告）日： | 2022-12-20 |
| 发明（设计）人： | 朱怡安;周卫;李联;史先琛;姚烨 | 申请（专利权）人： | 西北工业大学 |
| 主分类号： | G06F30/33 | 分类号： | G06F30/33 |
| 代理公司： | 西安凯多思知识产权代理事务所(普通合伙) 61290 | 代理人： | 范倩 |
| 地址： | 71007*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明涉及计算机应用技术领域，具体公开了一种双时钟多核嵌入式并发时序仿真方法及装置，该方法包括：确定多核嵌入式系统内每个内核的内核速率及需仿真的仿真事件；根据所有内核的内核速率确定全局虚拟时钟的全局虚拟时钟速率；将全局虚拟时钟速率除以内核速率，获得每个内核的局部虚拟时钟相对全局虚拟时钟的内核时钟速率比；根据全局虚拟时钟当前周期数和各个内核时钟速率比之间的比值，依次判断各内核在各个全局虚拟时钟周期内是否需执行仿真，以在各个全局虚拟时钟周期内通过需执行仿真的内核对仿真事件进行仿真。本发明解决了因内核处理器频率不同导致的内核速度不匹配、造成仿真误差的问题。 | ||
| 搜索关键词： | 一种 时钟 多核 嵌入式 并发 时序 仿真 方法 装置 | ||
【主权项】：
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