[发明专利]可SerDes接口信号识别的FPGA原型验证平台在审
| 申请号： | 202211152522.4 | 申请日： | 2022-09-21 |
| 公开（公告）号： | CN115618773A | 公开（公告）日： | 2023-01-17 |
| 发明（设计）人： | 朱智敏;李京;卢笙;谢水源 | 申请（专利权）人： | 芯启源（上海）半导体科技有限公司 |
| 主分类号： | G06F30/30 | 分类号： | G06F30/30;G06F30/27;G06N3/04;G06N3/08;G06F115/12 |
| 代理公司： | 上海光华专利事务所(普通合伙) 31219 | 代理人： | 倪静 |
| 地址： | 201203 上海市浦东新区自由贸*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明的可SerDes接口信号识别的FPGA原型验证平台，通过使用了RTL代码实现机器学习算法，并用由Xilinx MGT接收模块输出的并行数据作为训练集进行训练，最终得出电路输入状态的预测模型，再基于该预测模型对输入模型的信号进行预测，并根据该预测结果恢复为输入所述加扰模块前由平台上的SerDes接口接收的串行数据；本发明有效的避免了由于部分MGT电路内部设计问题，使得电路识别输入为不定态，最终会产生错误的输出结果，对原型验证干扰问题的出现，方便在FPGA原型验证过程中能过清晰地掌握信号的输入状态，也可以及时的对输入进行调整，优化了整个流程。 | ||
| 搜索关键词： | serdes 接口 信号 识别 fpga 原型 验证 平台 | ||
【主权项】：
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