[其他]译码电路无效
| 申请号： | 86102311 | 申请日： | 1986-04-03 |
| 公开（公告）号： | CN1003761B | 公开（公告）日： | 1989-03-29 |
| 发明（设计）人： | 柳下横生 | 申请（专利权）人： | 冲电气工业株式会社 |
| 主分类号： | 分类号： | ||
| 代理公司： | 中国专利代理有限公司 | 代理人： | 叶凯东 |
| 地址： | 日本东京港*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明是关于将被编码了的图象接收，从该图象信号中检出附加于各页、各扫描线上的同步信号，对图象信息进行译码的译码电路。本发明具有所定段数的第１移位寄存器，接续于所说第１移位寄存器之最下段的输出，而有与附加于图象信号之前的同步信号的位数相对应的段数的第２移位寄存器，以及被接续于上述第１移位寄存器的各段输出及上述第２移位寄存器的各段输出的逻辑电路。根据本发明的译码电路，可以在短时间内正确地捕捉同步信号。 | ||
| 搜索关键词： | 译码 电路 | ||
【主权项】：
一种将被编码的图象接收，从该图象信号检出附加于各页、各扫描线的同步信号，对画象信进行译码的译码电路，其特征是，该译码电路具有一定段数的第1移位寄存器，以及有与接续于该第1移位寄存器的最下段而附加于图象信息之前的同步信号的位数相对应的段数的第2移位寄存器，以及被接于上述第1移位寄存器的各段输出及上述第2移位寄存器的各段输出的逻辑手段，将附加于图象信息之前的同步信号及接于其后的图象信息顺次地存储于上述第1及第2寄存器中，通过上述逻辑手段对同步信号加以识别。
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