[其他]微处理器芯片上的堆栈式超高速缓冲存储器无效
| 申请号： | 87100507 | 申请日： | 1987-01-26 |
| 公开（公告）号： | CN87100507A | 公开（公告）日： | 1987-11-25 |
| 发明（设计）人： | 格伦福德·J·迈尔斯;康拉德·黎;迈克尔·T·艾梅尔;格伦·欣顿;罗伯特·里奇斯 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F15/06 | 分类号： | G06F15/06 |
| 代理公司： | 中国专利代理有限公司 | 代理人： | 奚汉民,吴秉芬 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 微处理器芯片上的堆栈帧式超高速缓冲存储器及其相应的控制装置提供许多全局寄存器。其中之一是含有现行帧指示字的帧指示字寄存器，其余的则作通用寄存器供现行过程使用；还提供许多供现行过程执行浮点运算操作用的浮点寄存器。由多个寄存器组组成寄存器组组合，各寄存器组均由一些局部寄存器组成。与程序有关的局部寄存器含有包括指向前帧的指示字和指令指示字的连接信息，因而无需对片外存储器作访问就能执行大多数调用和返回指令。 | ||
| 搜索关键词： | 微处理器 芯片 堆栈 超高速 缓冲存储器 | ||
【主权项】：
1、为在可与主存储器连接的数据处理器中使用，一种所述数据处理器中的堆栈帧式超高速缓冲存储器和一种控制装置的特征在于其中包括：一个多元全局寄存器，其中所述全局寄存器中的一个是包含指向现行帧的现行帧指示字的帧指示字寄存器，其余所述全局寄存器则作为供现行过程使用的通用寄存器，一个由多个寄存器组组成的寄存器组组合，每一寄存器组由一些局部寄存器组成；依据调用指令的译码驱动的第一控制装置，用于从所述寄存器组组合中给所调用过程分配局部寄存器的寄存器组以及为建立现行帧对所述帧指示字寄存器进行初始化；依据返回指令的译码驱动的第二控制装置，用于释放所述寄存器组以便分配给由后一个调用指令所调用的另一个过程。
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