[其他]具有多个控制存贮器的用于微程序控制数据处理系统的装置和方法无效
申请号: | 87102161 | 申请日: | 1987-01-29 |
公开(公告)号: | CN87102161A | 公开(公告)日: | 1987-09-09 |
发明(设计)人: | 罗伯特·E·斯图尔特;唐纳德·F·胡珀 | 申请(专利权)人: | 数字设备公司 |
主分类号: | G06F9/22 | 分类号: | G06F9/22 |
代理公司: | 中国专利代理有限公司 | 代理人: | 匡少波 |
地址: | 美国马*** | 国省代码: | 暂无信息 |
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摘要: | 在所揭示的微程序控制的数据处理系统中,使用了多个控制存贮器,按照对宏指令顺序的响应控制该数据处理系统。在每个控制存贮器之间设置有锁存部件。这些锁存部件是在给定的地址上产生的,并在不同的系统时钟周期内把它加到每个控制存贮器上。由此,在不同的时钟周期内,从每个控制存贮中给出相对应的微指令段,并使它有可能通过中央处理机把其微指令段与其对应着的数据流协调一致。采用多个控制存贮器可以减少为延迟微指令段所需的“门”的数目。 | ||
搜索关键词: | 具有 控制 存贮器 用于 微程序 数据处理系统 装置 方法 | ||
【主权项】:
1、一个微程序控制的中央处理机,包括有:根据一个宏指令,能够处理数据信号组的多个部件,其中,把上述中央处理机划分成与一个微指令段相关联并相对应的逻辑部件组,并将每个微指令段按照予定的时间顺序加到所带的逻辑部件组上;第一控制存贮器对应于上述宏指令相连带着的第一地址信号组,并至少给出一个第一微指令段;以及第二控制存贮器,适于接收相对上述第一地址信号组的第二地址信号组,并至少给出一个第二微指令段,而且从上述第一个微指令段中按照不同的时钟周期产生该第二微指令段。
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