[实用新型]断相累加计时仪无效
| 申请号： | 92230406.8 | 申请日： | 1992-08-22 |
| 公开（公告）号： | CN2136479Y | 公开（公告）日： | 1993-06-16 |
| 发明（设计）人： | 王炎上 | 申请（专利权）人： | 王炎上 |
| 主分类号： | G01R31/02 | 分类号： | G01R31/02;G01R29/00 |
| 代理公司： | 河北省专利事务所 | 代理人： | 李羡民 |
| 地址： | 071000 河北*** | 国省代码： | 河北;13 |
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| 摘要： | 一种断相累加计时仪，由电压取样电路、电流取样电路，失压判定逻辑电路，累加计时显示电路及时基发生器，累加脉冲发生器，计时脉冲发生器等组成，它将目前以日月为计量单位的计时仪改进成以小时作计量单位的仪器，从而方便了应用，也为电力部门统计电量损失提供了准确的数据。 | ||
| 搜索关键词： | 累加 计时 | ||
【主权项】：
1、一种断相累加计时仪，它由电压取样电路、电流取样电路、失压判定逻辑电路，累加器及相应的显示器所组成，其特征在于，它还设有一个时基发生器1，累加脉冲发生器2及计时脉冲发生器3，所述时基发生器产生一个36秒为周期的循环计数信号，所述累加脉冲发生器2为一个三与门YM3，其三条输入线分别接分频器CD4040的06、07、011输出脚，所述计时脉冲发生器亦为一三与门电路，其三条输入线接分频器的06、07、011输出脚，07为07输出脚经非门F1反相获得，累加脉冲信号和计时脉冲信号均引至失压判定逻辑电路分别作为累加与计时操作的控制信号。
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