[发明专利]电信设备的双重控制处理器无效

专利信息
申请号: 93118454.1 申请日: 1993-09-30
公开(公告)号: CN1086364A 公开(公告)日: 1994-05-04
发明(设计)人: C·迪莱瓦;M·森巴迪 申请(专利权)人: 西门子长途电讯股份公司
主分类号: H04L1/22 分类号: H04L1/22
代理公司: 中国专利代理(香港)有限公司 代理人: 董巍
地址: 意大*** 国省代码: 暂无信息
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摘要: 发明涉及电信设备的双重控制处理器,它由两个互相连接在一起的相同控制器组成。每个控制器包括一个可作现用的或备用的处理器、一个为操作时提供处理数据的外围数据RAM和连接设备其余部分的数个外围电路。每个处理器的EPROM包括单部选择固件。该数据RAM和外围电路各自包括一个双门存取电路,它只允许选择存取现用的处理器。后者同步完成两个双重数据RAM的写入周期,在现用的处理器因故障而转换之后,用备用处理器能迅速恢复操作同步。
搜索关键词: 电信设备 双重 控制 处理器
【主权项】:
1、电信设备的双重处理器基本上是由两个相同的连接到设备的其余部分的控制器组成的,每个控制器包括一个对设备操作与控制进行必要处理的处理器、数个连接处理器总线的外围电路,以便协助处理器进行控制操作,其特征在于:--每个处理器(UP0、UP1)包括相应配置的控制电路(CCL0、CCL1),它产生单部选择信号(SEL0、SEL1)传向属于它们自己控制器(UC0、UC1)的外围电路(BL0C0、BL0C1),其信号的逻辑值确定选择对全套设备实施控制的现用处理器(UC0、UC1);--每个外围电路(I/U0、PER0、MES0、I/U1、PER1、MES1)包括各自的双门存取电路(ACC0、ACC1),两个处理器(UP0、UP1)的总线(BUS0、BUS1)接入电路的门,所述的存取电路还有一个控制输入端,所述的单部选择信号(SEL0、SEL1)进入控制输入端用于控制现用处理器的总线线路与备用处理器总线线路断路时的电气连接;--现用处理器存取其自己控制器(UC0、UC1)的通用外围电路,而且无区别地存取相应的双重外围电路,同时向企图存取的外围电路发送相应的启动信号(B0SEL、B1SEL),由所述存取电路(ACC0、ACC1)使用,以扩展现用的处理器。
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