[发明专利]用于检测维特比译码器中同步的方法和电路无效
| 申请号： | 93119980.8 | 申请日： | 1993-12-24 |
| 公开（公告）号： | CN1044757C | 公开（公告）日： | 1999-08-18 |
| 发明（设计）人： | 轟俊哉 | 申请（专利权）人： | 日本电气株式会社 |
| 主分类号： | H03M13/12 | 分类号： | H03M13/12;H04L7/00 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 马铁良,曹济洪 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 用于校验由维特比译码器在维特比译码处理中确定的最大路径度量状态已经转换定的之前的状态，使用最大路径尺度状态，并确定转换之间分支值的分支值输出电路。一个用于确定分支值和软判断接收数据之间在每个间隔中的相关性并输出表示每个间隔中相关性的相关值的相关器。一个根据每个间隔中的分支值确定接收的数据是否处在同步或非同步状态的同步／非同步判定电路。 | ||
| 搜索关键词： | 用于 检测 译码器 同步 方法 电路 | ||
【主权项】：
1．一种检测用于将接收的、卷积编码的数据用维特比算法解码的维特比译码器中同步的方法，包括步骤：校验由维特比译码器在维特比译码处理中确定的最大路径度量状态已经转换完的之前的状态，使有所述的最大路径度量状态和确定转换之间的分支值；确定所述的分支值和接收的数据之间在每个时间间隔中的相关性并输出表示每个时间间隔中所述相关性的相关值；根据每个间隔中所述的相关值确定接收的数据是否处于同步或非同步状态；如果确定接收的数据处于非同步状态则改变接收的数据的相位。
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