[实用新型]小型计算机磁芯存储器代换卡无效

专利信息
申请号: 94241835.2 申请日: 1994-05-03
公开(公告)号: CN2208724Y 公开(公告)日: 1995-09-27
发明(设计)人: 曹云乾;韩志刚 申请(专利权)人: 中国矿业大学
主分类号: G06F3/06 分类号: G06F3/06
代理公司: 中国矿业大学专利事务所 代理人: 仇润鹤
地址: 2210*** 国省代码: 江苏;32
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摘要: 一种新型的西屋公司W2500小型计算机磁芯存储器代换卡,是由SRAM、EPROM存储电路B2、地址通道B1、数据通道B3、读写控制电路B4、程序装载电路B5、电源监控电路B6等组成,插在原磁芯存储器的卡位上后,可进行1.作为主机内存在线工作;2.掉电程序保持;3离线程序装载。该卡存储容量为64K字(字长17位),是原磁芯存储器卡的2倍。该卡不仅具有原磁芯存储器卡的基本功能,而且重装程序迅速,并不再需用光电纸带输入机和磁带机。
搜索关键词: 小型 计算机 存储器 代换
【主权项】:
1、一种新型的小型计算机磁芯存储器代换卡,是由SRAM和EPROM存储电路B2、地址通道B1、数据通道B3、读写控制电路B4、程序装载电路B5、电源监控电路B6等组成,其特征在于:a.由SRAM芯片U1、U2、U3(HM62256)和EPROM芯片U16、U17、U18(27C512)构成的SRAM和EPROM存储电路,是将U1、U2、U3、U16、U17、U18的地址线A0~A15一一对应连接,且作为地址总线A0~A15;U1、U16的数据线D0~D7一一对应连接,且作为数据总线的低八位D0~D7,U2、U17的数据线D0~D7一一对应连接,且作为数据总线的高八位D8~D15,U3的D0端接U18的D0端,且作为数据总线的D16;U1、U2、U3的端(22端)、端(27端)、端(20端)分别对应连接,且将端与反门U10∶A的2端连接,端与反门U10∶B的4端连接,端与反门U10∶C的6端连接;U16、U17、U18的的端(20端)、端(22端)分别对应连接,且将端与反门U10∶E的10端(CE)连接,端与反门U10∶D的8端(OE2)连接;b.由锁存器U4、U5、U6(74LS373)、与非门U11、U12、U13、U14、U15∶A(74S03)构成的数据通道,是将U4的D0~D7端对应接来自底盘的DO0~DO7信号端,U4的Q0~Q7端分别对应接数据总线的D0~D7;U5的D0~D7端对应接来自底盘的DO8~DO15信号端,U5的Q0~Q7端分别对应接数据总线的D8~D15端;U6的D0端接来自底盘的DO16信号端,U6的Q0端接数据总线的D16;U4、U5、U6的端(1端)、ALE端(11端)分别对应连接;且将端与U7∶A的3端连接,ALE端与U7∶B的6端连接;数据总线的D0~D3端分别对应接U11的A1、A2、A3、A4端,数据总线的D4~D7端分别对应接U12的A1、A2、A3、A4端,数据总线的D8~D11端分别对应接U13的A1、A2、A3、A4端,数据总线的D12~D15端分别对应接U14的A1、A2、A3、A4端,数据总线的D16接U15∶A的1端;U11和U12的B1、B2、B3、B4端均接与门U7∶C的8端,U13、U14的B1、B2、B3、B4端和U15∶A的2端均接与门U7∶D的11端;U11的Y1~Y4端分别对应接底盘的~信号端,U12的Y1~Y4端分别对应接底盘的~信号端,U13的Y1~Y4端分别对应接底盘的~信号端,U14的Y1~Y4端分别对应接底盘的~信号端,U15∶A的3端接底盘的信号端;c.由总线驱动器U19、U20、U21、U22(74LS245)构成的地址通道,是将U21的B0~B7端分别对应接底盘的MA0~MA7信号端,U22的B0~B7端分别对应接底盘的MA8~MA15信号端;U21的A0~A7端分别对应与U19的A0~A7端连接,且作为地址总线的A0~A7;U22的A0~A7端分别对应与U20的A0~A7端连接,且作为地址总线的A8~A15。U19、U20、U21、U22的DIR端(1端)均接地;U19、U20的端(19端)均接反门U27∶D的11端,U21、U22的端(19端)均接反门U27∶A的3端。U19的B0~B3端分别对应接计数器U23∶A的Q0~Q3,U19的B4~B7端分别对应接计数器U23∶B的Q0~Q3。U20的B0~B3端分别对应接计数器U24∶A的Q0~Q3,U20的B4~B7端分别对应接计数器U24∶B的Q0~Q3;d.由可编程芯片U8、U9(82S123)、逻辑门U7(74S08)、反门U10∶A、U10∶B、U10∶C(74HC05)、与非门U15∶B、U15∶C(74LS03)、电阻R1~R7、发光管LED1、LED2、跳线PIN1构成的读写控制电路,是将跳线PIN1的1端接U15∶B的6端,PIN的2端接地址总线的A15,PIN的3端接U15∶B的4、5两端,PIN的4端接地;U15∶B的6端分别接U9的A0端和经电阻R5接VCC,U15∶C的10端与U28∶C的13端相连接,U15∶C的9端与U28∶B的1端相连接,U15∶C的8端分别接U9的A3端和经电阻R4接VCC;U9的A1端接底盘上的信号端,U9的A2端接底盘上的信号端,U9的A4端接U27∶A的3端(信号LOAD),U9的Q1端接U10∶C的5端,U9的Q2端经电阻R3和反接的发光管LED2后接VCC,U9的Q3端接U8的A3端,U9的Q4端经电阻R7和反接的发光管LED1后接VCC;U10∶C的6端分别接和经电阻R6接+5V;U8的10端接底盘RSWT信号端,U8的11端接底盘WSWT信号端,U8的12端接底盘INH信号端,U8的14端接U27∶A的3端(信号LOAD),U8的1端接U7∶C的9端和U7∶D的12端,U8的2端接U7∶A的1、2端,U8的3端接U7∶B的5端,U8的4端接U10∶A的1端,底盘上的XDRIVE信号端分别接U7∶B的4端、U7∶C的10端、U7∶D的13端;U7∶B的6端接L1和U10∶B的3端U10∶B的4端接和经电阻R2接+5V,U10∶A的2端接和经电阻R1接+5V;e.由反门U10∶D、U10∶E(74HC05)、计数器U23、U24、U25(74LS393)、与非门U26、U27(74LS00)、电阻R8~R15、电容C1、发光管LED3、LED4、开关S1、跳线PIN2、晶振CRY构成的程序装载电路,是将开关S1的触点“0”接地,触点“1”分别接U27∶A的2端和经电阻R8接VCC,触点“2”分别接U27∶D的12端和经电阻R8接VCC;U27∶A的1端分别接U27∶D的11端、U23~U25的12端、U23~U25的2端和经电阻R10接VCC;U27∶D的13端分别接U27∶A的3端(信号LOAD)、U27∶B的4端、U26∶B的5端、U10∶E的11端和经电阻R11接VCC;VCC经顺接发光管LED4、R13后分别接U27∶B的6端和U26∶C的10端;U27∶B的5端接U25∶B的11端,U25∶B的13端接U24∶B的8端,U24∶B的13端接U24∶A的6端,U24∶A的1端接U23∶B的8端,U23∶B的13端接U23∶A的6端,U23∶A的1端接U26∶D的11端;U26∶B的4端分别经电阻R12接U26∶A的1、2两端和经电容C1、晶振CRY后接U26∶A的3端,U26∶A的1、2两端分别再接U26∶B的6端和U26∶C的9端,U26∶C的8端接U25∶A的1端。U25∶A的6端分别接U10∶D的9端和U27∶C的9、10两端,U27∶C的8端分别接U26∶D的12、13两端和经电阻R15、反接发光管LED3后接VCC、U10∶E的10端分别接CE线和经电阻R15接+5V;跳线PIN2的3端接U10∶D的8端(OE2线),跳线PIN2的2端接U1、U2、U3的端,跳线PIN2的4端接U1、U2、U3的端;f.电源监控电路是由上电延迟电路、掉电保护电路、电源转换电路和电池支持电路及电池电压监视电路所构成。
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