[发明专利]产生地址的卷积交错器及其方法无效

专利信息
申请号: 97117190.4 申请日: 1997-07-02
公开(公告)号: CN1179651A 公开(公告)日: 1998-04-22
发明(设计)人: 权五相 申请(专利权)人: 大宇电子株式会社
主分类号: H03M13/12 分类号: H03M13/12
代理公司: 永新专利商标代理有限公司 代理人: 蹇炜
地址: 韩国*** 国省代码: 暂无信息
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摘要: 一种用于交错由N个数据构成具有预定交错电平B的数据流以随机化该数据流而纠错的卷积交错器,包括输入缓冲器;存储器;地址生成单元;输出缓冲器;和控制器,并公开一种生成存储器地址的方法。在生成存储器地址的方法中,垂直端数目为B-1和水平长度为(B-1)×M单元的基本存储器变换为垂直端数目为B-1和水平长度为(B/2)×M单元的中间存储器,并生成存取中间存储器的物理地址。
搜索关键词: 产生 地址 卷积 交错 及其 方法
【主权项】:
1、一种用于交错由N个数据构成具有交错电平B的数据流以随机化该数据流而纠错的卷积交错器,其特征在于包括:一个输入装置,用于分别在第一时钟周期期间输入该数据流并输出交错电平的第一输入数据以及在第二到第B时钟的前半周期期间保留交错电平的B-1个输入数据;一个存储器,具有垂直端为B-1及水平长度为(B/2)×M单元的一个中间存储器,B-1个垂直端及(B/2)×M单元存储交错电平的第二数据和第B数据的一部分,(B/2)×M单元存储交错电平的第三数据和第B-1数据的一部分,…,(B/2)×M单元分别存储连续沿垂直向定位的交错电平的剩余第B数据,(这里,M=N/B);一个地址生成装置,用于将垂直端的数目为B-1及水平长度为(B-1)×M单元的基本存储器变换为所述中间存储器以生成用于存取所述中间存储器的物理地址;一个输出装置,用于分别在第一时钟周期期间从所述输入装置输出数据以及在第二到第B时钟的每一个期间从所述存储器输出数据;和一个控制器,用于从所述地址生成装置接收基本垂直地址并产生用于控制所述输入装置,所述输出装置,和所述存储器的多个控制信号。
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