[发明专利]锁相环电路、再现装置和相位锁定方法无效
申请号: | 98122610.8 | 申请日: | 1998-11-19 |
公开(公告)号: | CN1217610A | 公开(公告)日: | 1999-05-26 |
发明(设计)人: | 中沢徹二 | 申请(专利权)人: | 索尼株式会社 |
主分类号: | H03L7/00 | 分类号: | H03L7/00;G11B19/28 |
代理公司: | 上海专利商标事务所 | 代理人: | 孙敬国 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | 本发明提供锁相环电路、再现装置和相位锁定方法,通过它们可以加宽捕获范围和锁定范围。在锁定锁相环电路之前,参考石英振荡器的参考时钟,对压控振荡器输出时钟进行计数,而且提取在从磁盘和参考时钟再现行程长度有限码之间的误差分量。然后,根据输出时钟的计算值与提取的误差分量的相加结果,构成PLL电路。在锁定锁相环电路之后,检测压控振荡器的输出时钟对从磁盘再现的行程长度有限码的相位误差,而且根据检测的相位误差构成PLL电路。 | ||
搜索关键词: | 锁相环 电路 再现 装置 相位 锁定 方法 | ||
【主权项】:
1.一种锁相环电路,其特征在于,包括:用于生成具有预定频率的参考信号的参考信号生成装置;用于根据由所述参考信号生成装置生成的参考信号,对压控振荡器的输出时钟频率进行计数的第一计数装置;用于根据由所述参考信号生成装置输出的参考信号对输入的行程长度有限码的频率进行计数的第二计数装置;用于计算由所述第一计数装置计数的所述压控振荡器的输出时钟的频率和由所述第二计数装置计数的行程长度有限码的频率之间的差异信息的计算装置;用于在所述压控振荡器的输出时钟和输入的行程长度有限码之间提取相位误差低频分量的提取装置;用于有选择地在从所述提取装置提供的所述相位误差低频分量和从所述计数装置提供的所述差异信息之间变换的变换装置;用于积分所述变换装置的输出的积分装置;用于在所述压控振荡器的所述输出时钟和所述输入的行程长度有限码的频率之间进行相位比较并输出相位比较信息的相位比较装置;用于把所述积分装置的积分输出和来自所述相位比较装置的所述相位比较信息相加以产生振荡控制信号并向所述压控振荡器输出振荡控制信号的加法装置;用于鉴别锁相环是否锁定的锁定鉴别装置;和用于如下控制的变换控制装置,从而当由所述相位鉴别装置确定锁定所述锁相环时,选择从所述提取装置提供的所述相位误差低频分量,以输入到所述积分电路,或者当由所述相位鉴别装置确定没有锁定所述锁相环时,选择从所述计数装置提供的所述差异信息以输入到所述积分电路。
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