[发明专利]时钟控制方法及其控制电路无效
| 申请号： | 99109037.3 | 申请日： | 1999-06-14 |
| 公开（公告）号： | CN1239356A | 公开（公告）日： | 1999-12-22 |
| 发明（设计）人： | 佐伯贵范 | 申请（专利权）人： | 日本电气株式会社 |
| 主分类号： | H03L7/00 | 分类号： | H03L7/00 |
| 代理公司： | 中原信达知识产权代理有限责任公司 | 代理人： | 穆德骏,余朦 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 提供降低抖动的时钟控制电路及其控制方法。至少配有一个平均化电路，该电路相对于由第一和第二输入端输入的第一和第二信号，生成具有内分所述第一和第二信号时间差的时间差信号，并从输出端输出，在所述平均化电路的第一和第二输入端上，输入第一和第二时钟信号，生成将所述第一和第二时钟信号脉冲间的时间差平均化的时钟。 | ||
| 搜索关键词： | 时钟 控制 方法 及其 控制电路 | ||
【主权项】：
1.一种时钟控制电路，该时钟控制电路至少配有一个时序平均化电路，相对于从第一和第二输入端输入的第一和第二信号，生成具有按预定比例内分所述第一和第二信号时间差的时间差信号，并从输出端输出，其特征在于，在所述时序平均化电路的第一和第二输入端供给第一和第二时钟信号，生成具有将所述第一和第二时钟信号脉冲间的时间差内分的时间差的时钟信号。
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