[发明专利]降低信号相位调制的数字控制电路无效

专利信息
申请号: 99802240.3 申请日: 1999-01-18
公开(公告)号: CN1288621A 公开(公告)日: 2001-03-21
发明(设计)人: A·皮策尔;T·欣兹 申请(专利权)人: 因芬尼昂技术股份公司
主分类号: H04J3/06 分类号: H04J3/06;H03L7/081;H03L7/093
代理公司: 中国专利代理(香港)有限公司 代理人: 郑立柱,张志醒
地址: 德国*** 国省代码: 暂无信息
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摘要: 降低信号(SYNC)相位调制的数字控制电路,具有一个多相位脉冲发生器(12),其产生一个脉冲(REF-CLK)的n个相位,该脉冲总计为信号(SYNC)的m倍,并且具有一个乘法器(14),其具有适合于该脉冲(REF-CLK)的n个相位的n个输入端和一个输出端,该输出端提供输出信号(MCLK),其中输出信号(MCLK)和信号(SYNC)与一个相位比较器(18)的输入端连接,其输出信号被供给一个σ-△调制器(26),其输出信号(command,direction)用于控制乘法器(14)。一个抖动的输入信号(SYNC)在相位比较器中与一个主脉冲(MCLK)比较。已确定的相位差在σ-△调制器中积分。电路的目的是数字地并且没有使用外围元件地产生一个消除抖动的时钟。通过该电路,根据P调节器特性以20db/十进制衰减SYNC信号的抖动。
搜索关键词: 降低 信号 相位 调制 数字控制 电路
【主权项】:
1.降低信号(SYNC)的相位调制的数字控制电路,具有一个多相位脉冲发生器(12),其产生一个脉冲(REF-CLK)的n个相位,该脉冲为信号(SYNC)的m倍,并且具有一个乘法器(14),其具有适合于该脉冲(REF-CLK)的n个相位的n个输入端和一个输出端,其提供输出信号(MCLK),其中输出信号(MCLK)和信号(SYNC)与相位比较器(18)的输入端连接,其特征在于,相位比较器的输出信号被供给一个σ-Δ调制器(26),其输出信号(command,direction)用于控制乘法器(14)。
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