[发明专利]时钟信号控制方法及电路和使用其的数据传输装置无效
申请号: | 00109431.9 | 申请日: | 2000-06-23 |
公开(公告)号: | CN1279550A | 公开(公告)日: | 2001-01-10 |
发明(设计)人: | 佐伯贵范 | 申请(专利权)人: | 日本电气株式会社 |
主分类号: | H04L7/02 | 分类号: | H04L7/02;H03K5/00 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 穆德骏,方挺 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 时钟 信号 控制 方法 电路 使用 数据传输 装置 | ||
1.一种时钟信号控制电路,其特征在于,使具有相位误差的多相时钟信号相互作用,一边保持上述各时钟信号的相位,一边对上述各时钟信号的相位误差成分进行均衡。
2.一种时钟信号控制电路,其特征在于,把均衡电路分成多个均衡电路群,该均衡电路使具有相位误差的多相时钟信号相互作用,一边保持上述各时钟信号的相位,一边对上述各时钟信号的相位误差成分进行均衡,在各个上述均衡电路群中,在不同的状态下进行均衡。
3.一种时钟信号控制电路,对具有不同相位误差的n个脉冲的相位误差进行均衡,得到相位误差被均衡的n个脉冲,其特征在于,
设置并列配置的两个以上的门,通过连接这些门的输出来形成对输入到上述门中的两个以上的脉冲的相位误差进行均衡的单位均衡电路,通过设置n个该单位均衡电路,来形成用于均衡上述n个脉冲的相位的误差的均衡电路群,该均衡电路群共设置log2n段,同时,在输入上述n个脉冲的第一均衡电路群的各个均衡电路的一方的输入侧,设置反相电路。
4.根据权利要求3所述的时钟信号控制电路,其特征在于,把上述n个脉冲输入到第一均衡电路群的不同的两个单位均衡电路中,把上述第一均衡电路群的各个单位均衡电路的输出分别输入到设在上述第一均衡电路群的后段中的第二均衡电路群的不同的两个单位均衡电路中。
5.根据权利要求4所述的时钟信号控制电路,其特征在于,把前段的上述均衡电路群的各个单位均衡电路的输出分别输入到设在上述前段的均衡电路群的后段的均衡电路群的不同的两个单位均衡电路中。
6.根据权利要求3至5任一项所述的时钟信号控制电路,其特征在于,在上述多个均衡电路群中的至少一个均衡电路群的各个单位均衡电路中,把相位相差π/2k(I=0,1,2,…)弧度的不同信号相互进行均衡。
7.根据权利要求6所述的时钟信号控制电路,其特征在于,各均衡电路群的上述k的值是不同的。
8.根据权利要求3至5任一项所述的时钟信号控制电路,其特征在于,在上述多个均衡电路群中的至少一个均衡电路群的各个单位均衡电路中,把相位相差π弧度的不同信号相互进行均衡。
9.根据权利要求3至5任一项所述的时钟信号控制电路,其特征在于,在上述多个均衡电路群中的至少一个均衡电路群的各个单位均衡电路中,把相位相差π/2弧度的不同信号相互进行均衡。
10.根据权利要求3至5任一项所述的时钟信号控制电路,其特征在于,在上述多个均衡电路群中的至少一个均衡电路群的各个单位均衡电路中,把相位相邻的信号相互进行均衡。
11.一种时钟信号控制电路,对具有不同相位误差的n个脉冲的相位误差进行均衡,得到相位误差被均衡的n个脉冲,其特征在于,
形成单位均衡电路,由第一差动对、该差动对的各个晶体管的负荷、以及与上述第一差动对并联连接的第二差动对组成,通过向上述各个差动对输入相位相差π弧度的不同脉冲信号,来对分别输入上述第一差动对和第二差动对的4个脉冲的相位误差进行均衡,通过设置n/2个该单位均衡电路,来形成用于对上述n个脉冲的相位的误差进行均衡的均衡电路群,该均衡电路群设置log2(n/2)段。
12.根据权利要求11所述的时钟信号控制电路,其特征在于,把上述n个脉冲输入到第一均衡电路群的不同的两个单位均衡电路中,把上述第一均衡电路群的各个单位均衡电路的输出分别输入到设在上述第一均衡电路群的后段中的第二均衡电路群的不同的两个单位均衡电路中。
13.根据权利要求12所述的时钟信号控制电路,其特征在于,把前段的上述均衡电路群的各个单位均衡电路的输出分别输入到设在上述前段的均衡电路群的后段中的均衡电路群的不同的两个单位均衡电路中。
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