[发明专利]集成存储器及相应的工作方法无效
申请号: | 00803218.1 | 申请日: | 2000-01-25 |
公开(公告)号: | CN1339158A | 公开(公告)日: | 2002-03-06 |
发明(设计)人: | H·赫尼格施米德;G·布劳恩;Z·曼约基;T·贝姆;T·雷尔;S·拉默斯 | 申请(专利权)人: | 因芬尼昂技术股份公司 |
主分类号: | G11C7/06 | 分类号: | G11C7/06;G11C11/409 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 程天正,张志醒 |
地址: | 德国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 集成 存储器 相应 工作 方法 | ||
1.集成存储器,
-具有一些存储单元(MC),它们布置在字母(WLi)与位线(BLi)的交叉点中,
-具有一种差动读放大器(SA),它通过多路转换器(MUX)与三个位线(BLi)相连,
-其多路转换器(MUX)根据其控制把所述读放大器(SA)的差动输入分别电连接到与其相连的三个位线(BLi)中的任意两个上。
2.如权利要求1所述的集成存储器,
-具有第一类型的字线(WL0,WL3),它们在其与第一位线(BL1)及第三位线(BL3)的交叉点中具有存储单元(MC),
-具有第二类型的字线(WL1,WL4),它们在其与第二位线(BL2)及第三位线(BL3)的交叉点中具有存储单元(MC),
-具有第三类型的字线(WL2,WL5),它们在其与第一位线(BL1)及第二位线(BL2)的交叉点中具有存储单元(MC)。
3.权利要求2所述的集成存储器的工作方法,
-其中,每次在与同一字线(WLi)相连的存储单元(MC)中存储并协的数据,然后又读出来,
-而且其中,在读或写访问时,与所述两个存储单元(MC)相连的两个位线(BLi)通过所述的多路转换器(MUX)被电连接到所述读放大器(SA)的差动输入端上。
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