[发明专利]用以执行多重指令组的数据处理装置无效
申请号: | 01101709.0 | 申请日: | 2001-01-21 |
公开(公告)号: | CN1332407A | 公开(公告)日: | 2002-01-23 |
发明(设计)人: | 高民晟;梁景哲;桂念慈 | 申请(专利权)人: | 智原科技股份有限公司 |
主分类号: | G06F9/30 | 分类号: | G06F9/30 |
代理公司: | 柳沈知识产权律师事务所 | 代理人: | 马莹 |
地址: | 台湾省新竹*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 用以 执行 多重 指令 数据处理 装置 | ||
1.一种用以执行多重指令组的数据处理装置,包括:
一存储器,用以存储多个指令组的多个指令;
一处理器核,用以执行这些指令中的一主要指令;
一程序计数寄存器,用以定出存储于该存储器中,下一个指令的地址;
多个数据寄存器,用以存储这些指令的数据;
一处理器状态寄存器,用以存储该处理器核的一状态,其中该处理器核包括一指令组选择标记,以指示出这些指令组的现行指令;
一前置解码器,用以将至少一个这些指令组转换成该主要指令;
一快取存储器,用以存储该主要指令,其中该快取存储器包括一指令组选择标记,以指示出所存储指令线路的指令类别;
一解码器,用以将该主要指令予以解码,其中该处理器核是用来执行用该解码器解码的主要指令;
一程序计数控制器,对应该指令组选择标记,以修正一程序计数器值,以调整与该主要指令不同指令的长度;以及一总线,作为该快取存储器及系统存储器之间的接口。
2.如权利要求1所述的用以执行多重指令组的数据处理装置,每一个数据寄存器具有两个位部分,其中至少一个位被视为一指令组选择位,以及另一位被视为一目标地址。
3.如权利要求2所述的用以执行多重指令组的数据处理装置,该目标地址为该指令组的一起始地址。
4.如权利要求2所述的用以执行多重指令组的数据处理装置,其中依据在这些数据寄存器中的指令选择位,该指令组选择被设定为一特定的分支指令。
5.如权利要求1所述的用以执行多重指令组的数据处理装置,其中该前置解码器包括至少一个次解码器,以将至少一个指令组翻译成该主要指令。
6.如权利要求1所述的用以执行多重指令组的数据处理装置,其中该快取存储器增加一个指令组选择位,以指出所存储指令的指令类别。
7.如权利要求1所述的用以执行多重指令组的数据处理装置,其中该指令选择器包括至少一位。
8.如权利要求1所述的用以执行多重指令组的数据处理装置,其中该指令组选择标记可以依据一个或多个数据寄存器的指令组位,而被一特定分支指令设定。
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