[发明专利]一种相位可调的基带滤波优化实现方法及装置无效

专利信息
申请号: 01107665.8 申请日: 2001-03-21
公开(公告)号: CN1329412A 公开(公告)日: 2002-01-02
发明(设计)人: 林巍;沈爱民 申请(专利权)人: 深圳市中兴集成电路设计有限责任公司
主分类号: H04J13/02 分类号: H04J13/02;H03H17/02
代理公司: 深圳睿智专利事务所 代理人: 胡吉科
地址: 518058 广东省深圳*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 相位 可调 基带 滤波 优化 实现 方法 装置
【说明书】:

本发明涉及通信用滤波器技术,特别涉及基带FIR成形滤波器技术。

FIR数字滤波器普遍应用于CDMA(码分多址)基带处理中。在IS-95和CDMA2000中也都推荐使用1∶4零插值的48阶FIR滤波器。

在CDMA基带处理链路中,FIR滤波器的所处位置可以在信道增益、多信道合并之前,此时FIR滤波器的输入为符号映射码片+1、-1、0,滤波器较简单,但每个信道都需要2个滤波器(正交的I路和Q路各1个);FIR滤波器的所处位置也可以在信道增益、多信道合并之后,此时FIR滤波器的输入为多位的合成值,总共只需2个滤波器(正交的I路和Q路各1个)。FIR滤波器的所处位置不同,其实现方法也不同。在CDMA2000中,信道个数较多,所以本发明是针对后者进行优化实现的,在保证精度的情况下,输入为16bit。在现有技术中,按照48阶FIR滤波器差分方程 y ( n ) = Σ k = 0 47 h ( k ) x ( n - k ) ]]>直接实现1∶4零插值的48阶FIR滤波器需要许多位数较大的乘法器和加法器,这在ASIC(专用集成电路)和FPGA(现场可编程门阵列)实现中很复杂,将占用大量资源。

在现有技术中也有一些改进方法,如XINLINX公司公开的相关资料中提到使用KCM(常系数乘法器)来简化FIR滤波器的实现。虽然比直接实现方式有明显改进,但没有充分利用多种优化方法,效果仍不够理想。

在中国专利97195820中,将信道增益、多信道合并与FIR滤波器组合在一起优化,不利于信道增益的动态调整,且在信道个数较多的CDMA2000中,实现起来也较复杂。

在中国专利97194884中,提出的基于ROM的FIR滤波器实现方法,其前提条件是FIR滤波器位置在信道增益、多信道合并之前,其输入为符号映射码片+1、-1、0。所以此方法不适于FIR滤波器的处于信道增益、多信道合并之后,输入为多位的合成值的情况。

现有技术的直接方法实现复杂,占用资源太大,不利于ASIC或FPGA实现。一些改进方法,又没有综合采用多种优化方法,没有充分利用系统可提供的条件,优化程度低,占用资源较大。此外,也没有考虑到FIR滤波器的相位可调。而FIR滤波器的相位可调在CDMA2000系统中是很有用处的。

本发明的目的在于避免现有技术的不足之处而提供一种基于1∶4零插值、充分利用系统条件,占用资源小、相位可调的基带48阶FIR滤波优化实现方法及装置,以及精简硬件位宽的方法,以降低系统成本,提高系统运行效率。

本发明的目的可以通过采用以下技术方案来实现:

设计、实施一种相位可调的基带滤波优化实现方法,利用逻辑电路,完成48阶1∶4零插值滤波。尤其是让信号经过并串转换器后分别经四组SDA(串行分布式算法)电路、加法器和移位寄存器处理后,由四输入复用器输出。该优化实现方法适用于所有预设系数的基带FIR(有限冲激响应)成形滤波并具有以下步骤:

A.将数据宽度为m位,速率为n Mcps的数据信号送入并串转换器,

得到速率为m*n Mcps的串行码流;

B.将所述串行码流分别送入4相4抽头SDA电路;

C.每组串行SDA电路和加法器有如下处理分步骤:

  C1.第一SDA电路进行处理并将处理结果分别送第二SDA电路和第一

     加法器;

  C2.所述第二SDA电路将处理结果分别送第三SDA电路和第一加法

     器;

  C3.所述第一加法器的结果和所述第三SDA电路的结果均送第二加法

     器;

  C4.由第二加法器将运算和送延时寄存器;

D.延时寄存器每隔16时钟周期将第二加法器送来的数据送复用器并

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