[发明专利]时钟控制电路无效
| 申请号： | 02125146.0 | 申请日： | 2002-06-28 |
| 公开（公告）号： | CN1395368A | 公开（公告）日： | 2003-02-05 |
| 发明（设计）人： | 石见幸一 | 申请（专利权）人： | 三菱电机株式会社 |
| 主分类号： | H03K3/02 | 分类号： | H03K3/02 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 马铁良,叶恺东 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | |||
| 搜索关键词： | 时钟 控制电路 | ||
1.一种时钟控制电路，包含
中止时钟信号供给的门电路(1)；
门控制电路(12)，其响应第1信号由上述门电路中止上述时钟信号的供给，在上述第1信号从第1状态变为第2状态时总是在一定期间中止上述时钟信号的供给。
2.权利要求1记载的时钟控制电路，其中
上述门控制电路对上述第1信号和使该第1信号延迟(3)了的延迟信号进行运算(4)，向上述门电路输出指示中止上述时钟信号供给的第2信号。
3.权利要求1记载的时钟控制电路，其中
上述门控制电路对上述第1信号和将该第1信号计数(5)的计数信号进行运算(6)，向上述门电路输出指示中止上述时钟信号供给的第2信号。
4.权利要求1记载的时钟控制电路，其中
上述门控制电路响应上述第1信号生成逻辑电平变化的第2信号，同时在上述第2信号的逻辑电平变化的前后中止上述时钟信号的供给。
5.权利要求1记载的时钟控制电路，其中
上述第1信号是将记忆元件的记忆内容复位的复位信号。
6.一种时钟控制电路，包含
中止时钟信号供给的门电路(1)；
门控制电路(30)，其响应第1信号由上述门电路中止上述时钟信号的供给，同时响应上述第1信号生成逻辑电平变化的第2信号，在上述第2信号的逻辑电平变化的前后中止上述时钟信号的供给。
7.权利要求6记载的时钟控制电路，
具备判断上述时钟信号的频率是否在规定的频率以上的判断电路(91，92)，其中
上述门控制电路在上述时钟频率被判断为是在规定频率以上时，中止上述时钟信号的供给。
8.权利要求6记载的时钟控制电路，其中
上述第2信号是将记忆元件的记忆内容复位的复位信号。
9.一种时钟控制电路，包含
改变时钟信号频率的时钟变换电路(7)；
时钟切换电路(42)，其响应第1信号由上述时钟变换电路降低上述时钟信号的频率，当上述第1信号从第1状态向第2状态变化时，总是在一定期间降低上述时钟信号的频率。
10.权利要求9记载的时钟控制电路，其中
上述时钟切换电路对上述第1信号和使该第1信号延迟(3)了的延迟信号进行运算(4)，向上述时钟变换电路输出指示改变上述时钟信号频率的第2信号。
11.权利要求9记载的时钟控制电路，其中
上述时钟切换电路对上述第1信号和将该第1信号计数(5)的计数信号进行运算(6)，向上述时钟变换电路输出指示改变上述时钟信号频率的第2信号。
12.权利要求9记载的时钟控制电路，其中
上述时钟切换电路响应上述第1信号生成逻辑电平变化的第2信号，在上述第2信号的逻辑电平变化的前后降低上述时钟信号的频率。
13.权利要求9记载的时钟控制电路，其中
上述第1信号是将记忆元件的记忆内容复位的复位信号。
14.一种时钟控制电路，包含
改变时钟信号频率的时钟变换电路(7)；
时钟切换电路(32)，其响应第1信号由上述时钟变换电路使从上述时钟变换电路输出降低了频率的时钟信号，同时响应上述第1信号生成逻辑电平变化的第2信号，在上述第2信号的逻辑电平变化的前后使上述时钟信号的频率降低。
15.权利要求14记载的时钟控制电路，
具备判断上述时钟信号的频率是否在规定频率以上的判断电路(91，92)，其中
上述时钟切换电路在上述时钟信号频率被判断为在规定频率以上时，降低上述时钟信号的频率。
16.权利要求14记载的时钟控制电路，其中
上述第2信号是将记忆元件的记忆内容复位的复位信号。
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