[发明专利]用于DMA、任务终止和同步操作的缓存一致保持无效
申请号: | 200580018879.1 | 申请日: | 2005-05-31 |
公开(公告)号: | CN101617298A | 公开(公告)日: | 2009-12-30 |
发明(设计)人: | 伊塔伊·佩莱德;摩西·安舍尔;雅各布·埃弗拉特;阿隆·埃尔达尔 | 申请(专利权)人: | 飞思卡尔半导体公司 |
主分类号: | G06F12/08 | 分类号: | G06F12/08 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 黄启行;穆德骏 |
地址: | 美国得*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 dma 任务 终止 同步 操作 缓存 一致 保持 | ||
1.一种存储器缓存系统(105),包括:
存储器缓存(107),所述存储器缓存用于在存储器缓存上执行一 致操作;
用于接收用于地址组的地址组指示的装置(301),该地址组包括 与主存储器(103)相关联的多个地址;
其特征在于:
处理装置(303),用于顺序地处理缓存线组的每一缓存线;该处 理装置(303)包括:
匹配装置,用于通过评价匹配标准确定缓存线是否与地址组 的地址相关联;
一致装置,用于如果满足匹配标准,则在缓存线上执行一致 操作;以及
用于确定在一致操作和另一存储器操作之间是否存在冲突的 装置,其中一致装置操作为如果存在冲突则抑制一致操作。
2.如权利要求1的所述存储器缓存系统,其中匹配标准包括评价 与缓存线相关联的主存储器地址是否属于该地址组。
3.如权利要求2的所述存储器缓存系统,其中地址组指示包括主 存储器的存储器块的开始地址和结束地址,并且匹配标准包括确定主 存储器地址是否属于该存储器块。
4.如权利要求3的所述存储器缓存系统,其中开始地址和结束地 址是虚拟存储器地址。
5.如权利要求2至4的任何一项的所述存储器缓存系统,其中匹 配装置操作为响应于缓存线标记和缓存线索引,确定主存储器地址。
6.如权利要求1的所述存储器缓存系统,其中存储器缓存(105) 是组关联存储器缓存,并且缓存线组包括不同组关联存储器组的缓存 线。
7.如权利要求6的所述存储器缓存系统,其中处理装置(303) 操作为顺序地处理组关联存储器缓存的组。
8.如权利要求1的所述存储器缓存系统,其中地址组指示包括至 少一个任务标识的指示,并且匹配标准包括评价与第一缓存线相关联 的任务标识是否与至少一个任务标识匹配。
9.如权利要求8的所述存储器缓存系统,其中地址组指示存在于 任务标识中。
10.如权利要求1的所述存储器缓存系统,其中缓存线组包括存 储器缓存的所有缓存线。
11.如权利要求1的所述存储器缓存系统,其中所述冲突涉及在 一致操作和其他存储器操作之间共享的资源。
12.如权利要求1或11的所述存储器缓存系统,其中用于确定冲 突是否存在的装置操作为如果一致操作和其他存储器操作导致对相同 缓存资源的基本上同时的访问,则确定存在冲突。
13.如权利要求1的所述存储器缓存系统,其中一致装置操作为 通过延迟一致操作和其他存储器操作的一个,抑制一致操作。
14.如权利要求1的所述存储器缓存系统,其中一致操作是无效 操作。
15.如权利要求1的所述存储器缓存系统,其中一致操作是同步 操作。
16.如权利要求1的所述存储器缓存系统,其中一致操作是清除 操作。
17.如权利要求1的所述存储器缓存系统,其中处理装置(303) 包括用于响应于确定已经处理了缓存线组的全部缓存线而设定终止指 示的装置。
18.如权利要求17的所述存储器缓存系统,其中终止指示是中断 指示。
19.如权利要求1的所述存储器缓存系统,其中存储器缓存是指 令缓存。
20.如权利要求1的所述存储器缓存系统,其中存储器缓存是数 据缓存。
21.一种处理系统,包括:
处理器;
主存储器;
缓存存储器,连接到处理器和主存储器;以及
如权利要求1的所述存储器缓存系统。
22.一种在存储器缓存上执行一致操作的方法,包括以下步骤:
接收用于地址组的地址组指示,该地址组包括与主存储器(103) 相关联的多个地址;
其特征在于,包括下面的步骤:
顺序处理缓存线组的每一线;该处理包括对于缓存线组的每一缓 存线执行下面的步骤:
通过评价匹配标准,确定第一缓存线是否与地址组的地址相 关联,以及
如果满足匹配标准,则在第一缓存线上执行一致操作;
确定在一致操作和另一存储器操作之间是否存在冲突;以及
如果存在冲突,则通过一致装置抑制一致操作。
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