[发明专利]用于数字相位转换器的方法和装置有效

专利信息
申请号: 200580037829.8 申请日: 2005-10-21
公开(公告)号: CN101053197A 公开(公告)日: 2007-10-10
发明(设计)人: 尼古拉斯·G·卡法罗;托马斯·L·格拉迪沙尔;罗伯特·E·施滕格尔 申请(专利权)人: 摩托罗拉公司
主分类号: H04L7/00 分类号: H04L7/00
代理公司: 中原信达知识产权代理有限责任公司 代理人: 黄启行;陆锦华
地址: 美国伊*** 国省代码: 美国;US
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摘要:
搜索关键词: 用于 数字 相位 转换器 方法 装置
【权利要求书】:

1.一种在数字相位转换器(DPC)内产生输出信号的方法,该DPC包括用于产生时钟信号的频率源和延迟线,该延迟线被配置为接收时钟信号并在该延迟线上的多个相应输出抽头处产生多个相移时钟信号,该方法包括步骤:

接收基于期望的输出信号并用于识别延迟线上的第一输出抽头的控制信号;

根据该控制信号,在该延迟线上选择至少两个输出抽头,以接收至少两个不同相移时钟信号,其中该至少两个选择的输出抽头包括第一输出抽头和偏离该第一输出抽头预定数量输出抽头的第二输出抽头,并且其中从第一输出抽头接收第一相移时钟信号而从第二输出抽头接收第二相移时钟信号;以及

使用该控制信号和该至少两个所接收的相移时钟信号,产生是期望的输出信号的输出信号,其中产生输出信号进一步包括:

根据该控制信号和第二相移时钟信号,产生开窗口信号;以及

将该开窗口信号与第一相移时钟信号组合在一起,以产生输出信号。

2.根据权利要求1所述的方法,进一步包括步骤:

在时序逻辑器件的第一输入接收该控制信号;

在该时序逻辑器件的第二输入接收第二相移时钟信号;

在该时序逻辑器件的输出产生开窗口信号;以及

在至少一个组合逻辑器件,将该开窗口信号与第一相移时钟信号组合在一起,以产生输出信号。

3.根据权利要求1所述的方法,其中

由该频率源产生的该时钟信号包括多个连续时钟脉冲,该多个连续时钟脉冲限定多个相应连续时钟周期;以及

该输出信号包括多个连续输出脉冲,其中在多个时钟周期中的至少一个时钟周期内至少产生两个输出脉冲。

4.一种数字相位转换器(DPC),包括:

频率源,用于产生时钟信号;

延迟线,被配置为接收时钟信号,并在该延迟线上的多个相应输出抽头处产生多个相移时钟信号;

数字控制器件,连接到该频率源,用于根据期望的输出信号产生控制信号;以及

开窗口与选择电路,包括:

多个时序逻辑器件,每个具有至少一个连接到该数字控制器件以接收该控制信号的输入、至少一个连接到该延迟线上的输出抽头之一的其他输入、以及至少一个产生相应开窗口信号的输出;以及

组合网络,连接到多个时序逻辑器件的输出和多个输出抽头中的至少一部分,用于通过将来自该时序逻辑器件中的至少一部分的开窗口信号与所接收的相移时钟信号组合在一起来产生输出信号,其中该开窗口与选择电路:

将识别该延迟线上的第一输出抽头的控制信号接收到该时序逻辑器件的至少一个中;

根据该控制信号,在该延迟线上选择至少两个输出抽头,以接收至少两个不同相移时钟信号,其中该至少两个选择的输出抽头包括第一输出抽头和偏离该第一输出抽头预定数量输出抽头的第二输出抽头,并且其中从第一输出抽头接收第一相移时钟信号而从第二输出抽头接收第二相移时钟信号;以及

使用该组合网络利用该控制信号和该至少两个所接收的相移时钟信号,产生是期望的输出信号的输出信号,其中产生输出信号进一步包括:该组合网络根据该控制信号和第二相移时钟信号,产生开窗口信号,以及将该开窗口信号与第一相移时钟信号组合在一起,以产生输出信号。

5.根据权利要求4所述的DPC,其中多个时序逻辑器件中的每个时序逻辑器件是触发器。

6.根据权利要求4所述的DPC,其中该组合网络包括多个组合逻辑器件,该多个组合逻辑器件每个具有:至少一个输入,连接到该时序逻辑器件输出之一;至少一个其他输入,连接到该延迟线上的输出抽头之一;以及至少一个输出,连接到至少一个其他组合逻辑器件的输出。

7.根据权利要求6所述的DPC,其中多个组合逻辑器件包括:

多个与门,每个具有至少一个连接到时序逻辑器件输出之一的输入、至少一个连接到该延迟线上的输出抽头之一的其他输入、以及至少一个输出;以及

多个或门,将每个与门的输出连接在一起。

8.根据权利要求4所述的DPC,其中时序逻辑器件的数量与该延迟线上的输出抽头的数量相同,而且每个时序逻辑器件连接到不同输出抽头。

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