[发明专利]半导体器件及其制造方法有效
申请号: | 200580052304.1 | 申请日: | 2005-12-14 |
公开(公告)号: | CN101326635A | 公开(公告)日: | 2008-12-17 |
发明(设计)人: | 中川进一;三宫逸郎 | 申请(专利权)人: | 富士通株式会社 |
主分类号: | H01L21/8247 | 分类号: | H01L21/8247;H01L21/027;H01L27/115 |
代理公司: | 隆天国际知识产权代理有限公司 | 代理人: | 张龙哺 |
地址: | 日本神*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 半导体器件 及其 制造 方法 | ||
1.一种半导体器件的制造方法,其特征在于,包括:
通过在半导体衬底上形成元件分离绝缘膜,在上述半导体衬底上划定相互平行且隔开有间隔的多个带状的有源区域的工序;
在位于上述有源区域的上述半导体衬底上形成隧道绝缘膜的工序;
分别在上述隧道绝缘膜和上述元件分离绝缘膜上形成第一导电膜的工序;
在上述第一导电膜上涂敷光致抗蚀剂的工序;
使用曝光用掩模,对上述光致抗蚀剂进行曝光的工序,所述曝光用掩模具有在透明基板上相互平行地形成了多个带状的遮光图案的结构,所述遮光图案具有向末端宽度依次变窄的二个以上的宽度狭窄部;
对上述光致抗蚀剂进行显影,形成包含上述多个有源区域的每一个且相互分开的多个带状的抗蚀图案的工序;
将上述抗蚀图案用作掩模,选择性地对上述第一导电膜进行蚀刻的工序;
除去上述抗蚀图案的工序;
在除去上述抗蚀图案之后,分别在上述元件分离绝缘膜和上述第一导电膜上形成中间绝缘膜的工序;
在上述中间绝缘膜上形成第二导电膜的工序;
通过对上述第一导电膜、上述中间绝缘膜以及上述第二导电膜进行图案成形,在上述有源区域上形成依次形成有上述隧道绝缘膜、浮栅、上述中间绝缘膜以及控制栅的闪存单元,并在上述有源区域的末端的上述元件分离绝缘膜上形成依次形成有岛状的下部导体图案、上述中间绝缘膜的切片以及虚设导体图案的结构体的工序。
2.如权利要求1所述的半导体器件的制造方法,其特征在于,形成上述闪存单元和上述结构体的工序,包括:
第一蚀刻步骤,选择性地蚀刻除去在上述第二导电膜中不成为上述控制栅以及上述虚设导体图案的部分;
第二蚀刻步骤,选择性地蚀刻除去在位于上述控制栅和上述虚设导体图案之间的上述第一导电膜的上面所形成的上述中间绝缘膜;
第三蚀刻步骤,在对上述中间绝缘膜进行蚀刻之后,使用上述中间绝缘膜的蚀刻速率比上述第二导电膜的蚀刻速率更慢的蚀刻剂,选择性地蚀刻除去位于上述控制栅和上述虚设导体图案之间的上述第一导电膜。
3.如权利要求2所述的半导体器件的制造方法,其特征在于,
上述第三蚀刻步骤中的上述蚀刻剂采用Cl2和O2的混合气体,而且
上述第一导电膜采用多晶硅膜,上述中间绝缘膜采用ONO膜。
4.如权利要求1所述的半导体器件的制造方法,其特征在于,在形成上述闪存单元和上述结构体的工序中,将上述控制栅和上述虚设导体图案形成为带状,该带状是指,在与上述有源区域的延伸方向垂直的方向上相互平行地延伸的带状形状。
5.如权利要求4所述的半导体器件的制造方法,其特征在于,在形成上述闪存单元和上述结构体的工序中,将上述虚设导体图案的靠近上述控制栅一侧的长边形成在与上述遮光图案的上述宽度狭窄部相交的位置上。
6.如权利要求1所述的半导体器件的制造方法,其特征在于,在形成上述闪存单元和上述结构体的工序中,以包含上述下部导体图案的方式形成上述虚设导体图案。
7.如权利要求1所述的半导体器件的制造方法,其特征在于,在对上述光致抗蚀剂进行曝光的工序中,将曝光装置的焦点设定在不使上述遮光图案的投影像彼此连在一起的离焦范围内。
8.如权利要求1所述的半导体器件的制造方法,其特征在于,上述第一导电膜采用多晶硅膜。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造