[发明专利]监听访问的减少无效
申请号: | 200680023791.3 | 申请日: | 2006-06-29 |
公开(公告)号: | CN101213524A | 公开(公告)日: | 2008-07-02 |
发明(设计)人: | J·卡达什;D·威廉斯 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F12/08 | 分类号: | G06F12/08 |
代理公司: | 永新专利商标代理有限公司 | 代理人: | 王英 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 监听 访问 减少 | ||
1.一种装置,包括:
处理器核,用于:
接收页监听命令,所述页监听命令标识与由输入/输出(I/O)设备发出的存储器访问请求相对应的页地址;以及
逐出一个或多个与所述页地址相匹配的高速缓存行;以及
处理器监视逻辑,用于监视由所述处理器核进行的存储器访问,以确定所述处理器核存储器访问是否在所述页地址之内。
2.根据权利要求1所述的装置,其中,所述一个或多个高速缓存行位于与所述处理器核相耦合的高速缓存中。
3.根据权利要求2所述的装置,其中,所述高速缓存与所述处理器核位于同一集成电路管芯上。
4.根据权利要求1所述的装置,其中,所述页地址标识通过芯片组与所述处理器核相耦合的存储器的区域。
5.根据权利要求4所述的装置,其中,所述芯片组包括I/O监视逻辑,以监视由所述I/O设备进行的存储器访问。
6.根据权利要求5所述的装置,其中,所述芯片组包括存储器控制器,并且所述I/O监视器耦合在所述I/O设备和所述存储器控制器之间。
7.根据权利要求6所述的装置,其中,所述I/O监视器逻辑与所述存储器控制器位于同一集成电路管芯上。
8.根据权利要求1所述的装置,还包括多个处理器核。
9.根据权利要求8所述的装置,其中,所述多个处理器核位于单个集成电路管芯上。
10.一种方法,包括:
接收页监听命令,所述页监听命令标识与由输入/输出(I/O)设备发出的存储器访问请求相对应的页地址;以及
逐出一个或多个与所述页地址相匹配的高速缓存行;以及
监视由处理器核进行的存储器访问,以确定所述处理器核存储器访问是否在所述页地址之内。
11.根据权利要求10所述的方法,还包括:
如果所述处理器核存储器访问在所述页地址之内,则停止监视所述存储器访问。
12.根据权利要求10所述的方法,还包括:
如果I/O存储器访问在所述页地址之内,则访问与所述处理器核相耦合的存储器。
13.根据权利要求12所述的方法,其中,在不产生监听访问的情况下访问所述存储器。
14.根据权利要求10所述的方法,还包括:
监视由所述I/O设备进行的存储器访问。
15.根据权利要求10所述的方法,其中,所述处理器核存储器访问对与所述处理器核相耦合的存储器执行读或写操作。
16.根据权利要求10所述的方法,还包括:
从所述I/O设备接收所述存储器访问请求,其中,所述存储器访问请求标识在与所述处理器核相耦合的存储器之内的区域。
17.根据权利要求10所述的方法,还包括:
在接收所述存储器访问请求之后,启用处理器监视逻辑以监视由所述处理器核进行的存储器访问。
18.一种系统,包括:
易失性存储器,用于储存数据;
处理器核,用于:
接收页监听命令,所述页监听命令标识与由输入/输出(I/O)设备发出的对所述存储器的访问请求相对应的页地址;以及
逐出一个或多个与所述页地址相匹配的高速缓存行;以及
处理器监视逻辑,用于监视由所述处理器核进行的对所述存储器的访问,以确定所述处理器核存储器访问是否在所述页地址之内。
19.根据权利要求18所述的系统,还包括:
耦合在所述存储器和所述处理器核之间的芯片组,其中,所述芯片组包括I/O监视逻辑,用于监视由所述I/O设备进行的存储器访问。
20.根据权利要求18所述的系统,其中,所述易失性存储器是RAM、DRAM、SDRAM或SRAM。
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