[发明专利]具有稳健数据读出的存储器以及读出数据的方法有效
申请号: | 200680031794.1 | 申请日: | 2006-08-29 |
公开(公告)号: | CN101253570A | 公开(公告)日: | 2008-08-27 |
发明(设计)人: | B·L·翰特尔;张莎彦 | 申请(专利权)人: | 飞思卡尔半导体公司 |
主分类号: | G11C7/02 | 分类号: | G11C7/02 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 | 代理人: | 秦晨 |
地址: | 美国得*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 具有 稳健 数据 读出 存储器 以及 方法 | ||
1.一种存储器,包括:
第一读出放大器,耦连到第一局部数据线,具有用于将指示所选存储单元的状态的信号提供到所述第一局部数据线上的输出端子;
第二读出放大器,耦连到第二局部数据线,具有用于将指示所选存储单元的状态的信号提供到所述第二局部数据线上的输出端子;
第一逻辑门,具有耦连到所述第一读出放大器的所述输出端子的第一输入端子、耦连到所述第二读出放大器的所述输出端子的第二输入端子、以及输出端子;
第一三态驱动器,具有耦连到所述第一逻辑门的所述输出端子的数据输入端子、用于接收第一选择信号的控制输入端子、以及耦连到全局数据线的输出端子;以及
锁存器,具有耦连到所述全局数据线的输入/输出端子。
2.根据权利要求1的存储器,还包括分别预先充电所述第一和第二局部数据线的第一和第二读出放大器预先充电电路。
3.根据权利要求2的存储器,其中所述第一和第二读出放大器预先充电电路分别将所述第一和第二局部数据线预先充电到逻辑高电平,并且所述第一逻辑门包括NAND门。
4.根据权利要求1的存储器,其中所述锁存器还具有用于接收锁存信号的第一控制输入端子。
5.根据权利要求4的存储器,其中所述第一读出放大器还具有用于接收第一使能信号的使能输入端子,并且所述第二读出放大器还具有用于接收第二使能信号的使能输入端子,以及其中该存储器还包括在存储器存取周期的第一部分期间激活所述第一和第二使能信号中的一个,以及在所述存储器存取周期的所述第一部分之后的所述存储器存取周期的第二部分期间激活所述锁存信号的控制电路。
6.根据权利要求5的存储器,其中所述锁存器还具有用于接收预先充电信号的预先充电输入端子,其中所述控制电路在所述存储器存取周期的所述第一部分之前的所述存储器存取周期的第三部分期间激活所述预先充电信号。
7.根据权利要求1的存储器,还包括:
第三读出放大器,耦连到第三局部数据线,具有用于将指示所选存储单元的状态的信号提供到所述第三局部数据线上的输出端子;
第四读出放大器,耦连到第四局部数据线,具有用于将指示所选存储单元的状态的信号提供到所述第四局部数据线上的输出端子;
第二逻辑门,具有耦连到所述第三读出放大器的所述输出端子的第一输入端子、耦连到所述第四读出放大器的所述输出端子的第二输入端子、以及输出端子;以及
第二三态驱动器,具有耦连到所述第二逻辑门的所述输出端子的数据输入端子、用于接收第一控制信号的控制输入端子、以及耦连到所述全局数据线的输出端子。
8.一种存储器,包括:
第一组扇区,包括:
多个扇区,每一个扇区包括耦连到相应的局部数据线的多个读出放大器,每一个读出放大器具有用于将指示所选存储单元的状态的信号提供到相应局部数据线上的输出端子、以及逻辑门,逻辑门具有耦连到所述多个读出放大器的相应输出端子的多个输入端子、以及一个输出端子;
多个三态驱动器,每一个具有耦连到所述多个扇区中相应一个的所述逻辑门的所述输出端子的数据输入端子、用于接收多个选择信号中相应一个的控制输入端子、以及耦连到全局数据线的输出端子;以及
锁存器,具有耦连到所述全局数据线的输入/输出端子。
9.根据权利要求8的存储器,其中所述第一组扇区还包括预先充电所述局部数据线中的相应的局部数据线的多个读出放大器预先充电电路。
10.根据权利要求8的存储器,其中每一个读出放大器预先充电电路将所述局部数据线中的相应的局部数据线预先充电到逻辑高电平,并且所述多个扇区中的每一个的所述逻辑门包括NAND门。
11.根据权利要求8的存储器,其中所述锁存器还具有用于接收锁存信号的控制输入端子。
12.根据权利要求8的存储器,还包括:
至少一个另一组扇区,每一个具有与所述第一组扇区相同的组织和相应的全局数据线;以及
多路复用器,具有耦连到所述第一组扇区和所述至少一个另一组扇区的相应全局数据线的多个输入端子、用于接收组选择信号的控制输入端子、以及用于提供数据输出信号的输出端子。
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