[发明专利]一种可修复的像素结构有效

专利信息
申请号: 200710099778.2 申请日: 2007-05-30
公开(公告)号: CN101315505A 公开(公告)日: 2008-12-03
发明(设计)人: 赵继刚;金基用;徐宇博 申请(专利权)人: 北京京东方光电科技有限公司
主分类号: G02F1/1362 分类号: G02F1/1362;H01L27/12
代理公司: 北京同立钧成知识产权代理有限公司 代理人: 刘芳
地址: 100176北京*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 修复 像素 结构
【说明书】:

技术领域

发明涉及薄膜晶体管液晶显示器(TFT LCD)的结构,特别涉及TFT LCD一种可修复的像素结构。

背景技术

随着LCD生产的不断扩大,各个生产厂商之间的竞争也日趋激烈。各厂家在不断提高产品性能的同时,也再不断努力降低产品的生产成本,从而提高市场的竞争力。在降低产品成品的方法中,减少工艺数量,主要是减少光刻次数,从而提高生产速度、降低成本是目前各厂商普遍努力的主要方向。在近几年中,通过工程师们的努力,TFT LCD制造工艺中的光刻工艺数量不断减少。从最初的7次光刻工艺,到目前普遍使用的5次光刻工艺。掩模版(Mask)制造技术中发展出灰色调掩模版(gray tone mask)技术之后,使进一步减少光刻次数成为可能。目前个别LCD生产厂家已经在使用比较先进的4次光刻工艺(由于制造过程中1次光刻工艺需要采用1次掩模版进行掩模、曝光后刻蚀,故4次光刻又称“4mask”)。通过使用4次光刻工艺技术,生产速度和效率都有了很大的提高。

图1所示为现有技术中4mask工艺完成后的像素结构示意图;图2所示为图1A-A部位的截面图。如图1和图2所示,该像素结构包括:栅线3和数据线5,栅线3和数据线5交叉定义一个像素单元,每一像素单元包括:薄膜晶体管器件,像素电极6,其中薄膜晶体管包括:栅电极31,依次形成在栅电极31上方的栅极绝缘层2、半导体层4、掺杂半导体层7、源电极52,漏电极51,其中漏电极51通过钝化层8的过孔9与像素电极6相连;源电极52与数据线5为一体相连结构,源、漏电极之间为薄膜晶体管的沟道部分。

但是,4mask工艺又存在这其先天的缺陷和不足。由于使用了灰色调掩模版技术,将5mask中的有源层光刻(Active mask)和源、漏电极光刻(SDmask)在同一步光刻中完成,这就造成了工艺容差性较差。同时也使得产品工艺条件变得复杂而难以掌握,特别是在灰色调掩模版(Gray-Tone Mask)的光刻工艺中,参数和条件要求非常苛刻。由于这些原因,造成了4mask技术生产的产品成品率普遍低于传统5mask技术生产的产品。在4mask制造的薄膜晶体管(TFT)阵列基板的诸多不良中,像素TFT的沟道部分(channel)的有源层断路和源、漏电极(SD)短路现象较多出现。这是主要是由于4mask技术的特点所决定的。一般对于这两种不良采用的修理方法是将不良像素的TFT切断,使其成为暗点。这种修理方式使得TFT LCD的良品率下降。

发明内容

本发明的目的是针对现有技术的缺陷,提供一种可修复的像素结构,通过TFT旁边上增加备用的TFT,即TFT沟道旁边增加沟道修复部分,在原有的TFT发生缺陷时,启动备用的TFT,从而提高阵列基板的成品率和优等品率,进一步降低成本。

为了实现上述目的,本发明提供一种可修复的像素结构,包括:栅线和数据线,栅线和数据线交叉定义一个像素单元,每一像素单元包括:薄膜晶体管器件和透明像素电极,其中所述薄膜晶体管的沟道旁边形成有用于在所述沟道发生缺陷时启用的备用的源电极、备用的漏电极和备用的沟道,所述备用的源电极为所述薄膜晶体管的源电极,所述备用的漏电极形成在所述薄膜晶体管的源电极靠近所述透明像素电极的一侧。

上述方案中,所述备用的漏电极的部分位于像素电极之下。所述薄膜晶体管的沟道进一步为U型。所述备用的沟道进一步为一字型。所述备用的源电极和备用的漏电极与所述数据线、所述薄膜晶体管的源电极和漏电极可以为一次光刻工艺中形成的相同材料部分。所述数据线与所述薄膜晶体管的源电极进一步为一体结构。

相对于现有技术,本发明由于在TFT旁边上增加备用的TFT,即通过在使用灰色调掩模版形成源、漏电极和沟道的同时,在TFT沟道旁边形成备用TFT沟道结构,其源极部分与主TFT的源极相连,漏极位于像素电极之下。在LCD进行阵列工艺完成后如果某一像素的TFT部分发生断路或者短路之类的缺陷而无法修复时,在将缺陷沟道断开的同时,使用激光等方法直接连接备用TFT的漏极与像素电极,修复发生不良的像素,从而提高了阵列基板(Array)的成品率和优等品率,进一步降低了成本。

下面结合附图和具体实施例对本发明进行进一步更为详细地说明。

附图说明

图1是现有技术的像素结构示意图;

图2是图1中A-A部位截面图;

图3是本发明的像素结构示意图;

图4是图3中C-C位置的截面图;

图5是本发明使用的灰色调掩模版示意图。

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