[发明专利]时钟同步电路及具备该电路的半导体器件有效
申请号: | 200710129005.4 | 申请日: | 2007-06-29 |
公开(公告)号: | CN101098139A | 公开(公告)日: | 2008-01-02 |
发明(设计)人: | 远藤正己;河江大辅;黑川义元;池田隆之 | 申请(专利权)人: | 株式会社半导体能源研究所 |
主分类号: | H03L7/00 | 分类号: | H03L7/00;H04L7/00;G06K7/00 |
代理公司: | 上海专利商标事务所有限公司 | 代理人: | 张鑫 |
地址: | 日本神*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 时钟 同步 电路 具备 半导体器件 | ||
1.一种时钟同步电路,包括:
检测接收的数据的变化点并输出复位信号的装置;
输出时钟信号的时钟产生电路;
对所述时钟信号进行计数的时钟计数电路;
通过时钟产生用计数器获得时钟产生用计数值,根据时钟产生用计数值决定的 分频数对从所述时钟计数电路输出的信号进行分频的分频电路;以及
根据从所述分频电路输出的信号输出基准时钟信号的装置,
其中,在所述复位信号输入到所述时钟计数电路中的情况下,所述时钟计数电 路被配置成复位通过对所述时钟信号进行计数而获得的计数值,以及其中所述检测 所述接收的数据的变化点并输出所述复位信号的装置包括第一存储装置、第二存储 装置、以及对存储在所述第一存储装置中的第一信号和存储在所述第二存储装置中 的第二信号进行比较的比较装置。
2.根据权利要求1所述的时钟同步电路,其特征在于,所述第一存储装置和 所述第二存储装置中的至少一方是锁存电路。
3.根据权利要求1所述的时钟同步电路,其特征在于,所述时钟产生电路包 括环形振荡器。
4.根据权利要求1所述的时钟同步电路,其特征在于,所述时钟产生电路包 括晶体振荡器。
5.一种时钟同步电路,包括:
检测接收的数据信号的变化点的数据信号计数电路;
计数值比较电路,从所述数据信号计数电路输出的信号输入到所述计数值比较 电路;
输出时钟信号的时钟产生电路;
对所述时钟信号进行计数并获得计数值的时钟计数电路;
通过时钟产生用计数器获得时钟产生用计数值,根据时钟产生用计数值决定的 分频数对从所述时钟计数电路输出的信号进行分频的分频电路;以及
根据从所述分频电路输出的信号输出基准时钟信号的装置,
其中,所述计数值比较电路被配置成根据从所述数据信号计数电路输出的信号 输出复位信号,
并且,所述时钟计数电路被配置成根据所述复位信号复位所述计数值。
6.根据权利要求5所述的时钟同步电路,其特征在于,所述时钟产生电路包 括环形振荡器。
7.根据权利要求5所述的时钟同步电路,其特征在于,所述时钟产生电路包 括晶体振荡器。
8.一种半导体器件,包括:
用于通过无线通讯将信号发送到读写器并从读写器接收信号的天线;
检测从所述读写器接收的数据信号的变化点并输出复位信号的装置;
输出时钟信号的时钟产生电路;
对所述时钟信号进行计数的时钟计数电路;
通过时钟产生用计数器获得时钟产生用计数值,根据时钟产生用计数值决定的 分频数对从所述时钟计数电路输出的信号进行分频的分频电路;以及
根据从所述分频电路输出的信号输出基准时钟信号的装置,
其中,在所述复位信号输入到所述时钟计数电路中的情况下,所述时钟计数电 路被配置成复位通过对所述时钟信号进行计数而获得的计数值,以及其中检测所述 接收了的数据的变化点并输出所述复位信号的所述装置包括第一存储装置、第二存 储装置、以及对存储在所述第一存储装置中的第一信号和存储在所述第二存储装置 中的第二信号进行比较的比较装置。
9.根据权利要求8所述的半导体器件,其特征在于,所述第一存储装置和所 述第二存储装置中的至少一方是锁存电路。
10.根据权利要求8所述的半导体器件,其特征在于,所述时钟产生电路包括 环形振荡器。
11.根据权利要求8所述的半导体器件,其特征在于,所述时钟产生电路包括 晶体振荡器。
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