[发明专利]使用选择性蚀刻形成存储器的隔离结构的方法无效
申请号: | 200710142370.9 | 申请日: | 2007-08-22 |
公开(公告)号: | CN101136323A | 公开(公告)日: | 2008-03-05 |
发明(设计)人: | 朴大镇 | 申请(专利权)人: | 海力士半导体有限公司 |
主分类号: | H01L21/033 | 分类号: | H01L21/033;H01L21/8247;H01L21/762 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 彭久云;许向华 |
地址: | 韩国*** | 国省代码: | 韩国;KR |
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摘要: | |||
搜索关键词: | 使用 选择性 蚀刻 形成 存储器 隔离 结构 方法 | ||
1.一种选择性蚀刻方法,包括:
形成包括聚合物和碳纳米管的混合物;
将该混合物应用于蚀刻目标层上,藉此形成碳纳米管-聚合物复合层;
藉由图案化该碳纳米管-聚合物复合层来形成硬掩模,藉此选择性暴露该蚀刻目标层的一部分;以及
选择性蚀刻经由该硬掩模暴露的该蚀刻目标层。
2.如权利要求1所述的选择性蚀刻方法,其中该聚合物包括光致抗蚀剂,且
所述形成硬掩模的步骤包括曝光和显影该碳纳米管-聚合物复合层。
3.如权利要求1所述的选择性蚀刻方法,其中该聚合物包括有机抗反射涂层ARC。
4.一种使用选择性蚀刻方法隔离存储器的存储单元的方法,包括:
形成穿隧介电层于半导体基板上;
形成电荷储存层于该穿隧介电层上;
形成垫层于该电荷储存层上;
形成碳纳米管和聚合物的复合层于该垫层上以作为硬掩模;
顺序选择性蚀刻该垫层、该电荷储存层、该穿隧介电层、以及该半导体基板,其每个通过该硬掩模被暴露,以形成依据该电荷储存层的所得图案布置的沟槽;
形成绝缘层于该沟槽内,从而用该绝缘层填充该沟槽;以及
平坦化该绝缘层,直到暴露该垫层为止,藉此隔离每个存储单元。
5.如权利要求4所述的方法,其中该聚合物包括光致抗蚀剂。
6.如权利要求4所述的方法,其中该聚合物包括有机抗反射涂层ARC材料。
7.如权利要求4所述的方法,其中该垫层包括氮化硅层,该方法还包括在该垫层与该硬掩模之间的界面处形成具有比该氮化硅层的厚度小的厚度的氧化硅层作为次硬掩模。
8.如权利要求4所述的方法,其中该电荷储存层包括能存储通过隧穿到该穿隧介电层中而注入的电子的导电多晶硅层,以形成快闪存储器的控制栅极。
9.一种使用选择性蚀刻法形成具有存储单元的存储器的隔离结构的方法,包括:
形成穿隧介电层于半导体基板上;
形成电荷储存层于该穿隧介电层上;
形成垫层于该电荷储存层上;
形成包括光致抗蚀剂和碳纳米管的混合物;
涂覆该混合物于该垫层上,藉此形成碳纳米管-光致抗蚀剂复合层;
曝光和显影该复合层,藉此形成复合层图案作为硬掩模;
顺序选择性蚀刻该垫层、该电荷储存层、该穿隧介电层、以及该半导体基板,其每个通过该硬掩模被暴露,以形成依据该电荷储存层的所得图案布置的沟槽;
形成绝缘层于该沟槽内,以使用该绝缘层填充该沟槽;以及
平坦化该绝缘层直到暴露该垫层为止,藉此隔离每个存储单元。
10.如权利要求9所述的方法,其中该垫层包括氮化硅层,该方法还包括在该垫层与该硬掩模之间的界面处形成具有比该氮化硅层的厚度小的厚度的氧化硅层作为次硬掩模。
11.如权利要求9所述的方法,其中该电荷储存层包括能存储通过隧穿到该穿隧介电层中而注入的电子的导电多晶硅层,以形成快闪存储器的控制栅极。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造