[发明专利]施加浮动电压于源极或漏极区的操作存储器的装置与方法无效
申请号: | 200710185095.9 | 申请日: | 2007-11-08 |
公开(公告)号: | CN101183561A | 公开(公告)日: | 2008-05-21 |
发明(设计)人: | 郭明昌 | 申请(专利权)人: | 旺宏电子股份有限公司 |
主分类号: | G11C16/10 | 分类号: | G11C16/10;H01L27/112 |
代理公司: | 永新专利商标代理有限公司 | 代理人: | 王英 |
地址: | 中国台湾新竹*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 施加 浮动 电压 漏极区 操作 存储器 装置 方法 | ||
1.一种操作一非易失存储单元的方法,其包含一栅极、一源极区域、一漏极区域、一基材区域、一电荷储存结构、以及一或多个介电区域至少有部分位于所述电荷储存结构与所述栅极之间,且至少有部分位于所述电荷储存结构与所述基材区域之间,包含:
对应一指令,以将多个电子移动至所述电荷储存结构中,仅浮接所述源极区域或所述漏极区域之一,同时对未浮接的所述源极区域或所述漏极区域施加一第一电压。
2.如权利要求1所述的方法,其中所述施加所述第一电压的步骤,为施加一偏压安排的一部分,所述电荷储存结构储存至少二电荷储存状态,其每一个均对应所述电荷储存结构的一相异部分,同时所述偏压安排可改变全部的所述至少二电荷储存状态。
3.如权利要求1所述的方法,其中所述电子是由于多个空穴由所述未浮接的区域移动至所述基材区域所导致。
4.如权利要求1所述的方法,其中所述介电区域包含一带隙加工隧穿结构(Bandgap engineered tunnel structure),所述结构包含由上而下的一第一氧化硅、一氮化硅、一第二氧化硅三层构造。
5.如权利要求4所述的方法,其中所述第一氧化硅层的厚度小于20埃。
6.如权利要求4所述的方法,其中所述第一氧化硅层的厚度介于15至20埃之间。
7.如权利要求4所述的方法,其中所述氮化硅层的厚度小于20埃。
8.如权利要求4所述的方法,其中所述氮化硅层的厚度介于10至20埃之间。
9.如权利要求4所述的方法,其中所述第二氧化硅层的厚度小于20埃。
10.如权利要求4所述的方法,其中所述第二氧化硅层的厚度介于5至20埃之间。
11.如权利要求4所述的方法,其中所述第二氧化硅层的厚度小于15埃。
12.一种操作一非易失存储单元阵列的方法,其包含一栅极、一源极区域、一漏极区域、一基材区域、一电荷储存结构、与一或多个介电区域至少有部分位于所述电荷储存结构与所述栅极之间,且至少有部分位于所述电荷储存结构与所述基材区域之间,其中包含:
回应一指令,以将多个电子移动到所述至少一个非易失存储单元的所述电荷储存结构,浮接所述至少一个非易失存储单元的所述源极区域或所述漏极区域之一,同时对未浮接的所述源极区域或所述漏极区域施加一第一电压。
13.如权利要求12所述的方法,其中所述施加所述第一电压的步骤,为施加一偏压安排的一部分,所述电荷储存结构储存至少二电荷储存状态,其每一个均对应所述电荷储存结构的一相异部分,同时所述偏压安排可改变全部的所述至少二电荷储存状态。
14.如权利要求12所述的方法,其中所述电子由于多个空穴自所述未浮动的区域移动至所述基材区域所导致。
15.如权利要求12所述的方法,其中所述浮接与所述施加所述第一电压的步骤包含:
浮接一第一位线,其仅与所述至少一个非易失存储单元中的所述源极区域或所述漏极区域中的一个具有电接触,同时施加所述第一电压至一第二位线,其与所述至少一个非易失存储单元中未浮接的所述源极区域或所述漏极区域具有电接触。
16.如权利要求12所述的方法,其中所述阵列为一虚拟接地阵列。
17.如权利要求12所述的方法,其中所述阵列为一反及闸(NAND)阵列。
18.如权利要求12所述的方法,其中所述介电区域包含一带隙加工隧穿结构(Bandgap engineered tunnel structure),所述结构包含由上而下的一第一氧化硅、一氮化硅、一第二氧化硅三层构造。
19.如权利要求18所述的方法,其中所述第一氧化硅层的厚度小于20埃。
20.如权利要求18所述的方法,其中所述第一氧化硅层的厚度介于15至20埃之间。
21.如权利要求18所述的方法,其中所述氮化硅层的厚度小于20埃。
22.如权利要求18所述的方法,其中所述氮化硅层的厚度介于10至20埃之间。
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