[发明专利]具有改善缓冲器容量的使用的大容量存储系统有效

专利信息
申请号: 200880105134.2 申请日: 2008-08-26
公开(公告)号: CN101796479A 公开(公告)日: 2010-08-04
发明(设计)人: 斯蒂芬·埃伯林;约翰·马斯;沃尔夫冈·克劳斯伯格;托马斯·布龙 申请(专利权)人: 汤姆森特许公司
主分类号: G06F3/06 分类号: G06F3/06;G06F12/08
代理公司: 北京市柳沈律师事务所 11105 代理人: 吕晓章
地址: 法国布洛涅*** 国省代码: 法国;FR
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摘要:
搜索关键词: 具有 改善 缓冲器 容量 使用 存储系统
【权利要求书】:

1.一种大容量存储系统(1),其具有:实时数据接口(3)和大容量存 储阵列(10)之间的第一数据通道,所述第一数据通道包括SRAM或DRAM 数据缓冲器(7),其充当用于实时数据接口(3)和大容量存储阵列(10) 之间的实时高数据速率数据传输的缓冲器;以及嵌入式处理器(2)和大容 量存储阵列(10)之间的第二数据通道,其中SRAM或DRAM数据缓冲器 (7)也被用作嵌入式处理器(2)的主存储器(11)和大容量存储阵列(10) 之间的非实时数据传输的数据缓冲器。

2.根据权利要求1所述的大容量存储系统(1),其进一步具有数据开 关(5),所述数据开关(5)用于在来自或去往实时数据接口(3)的数据和 来自或去往嵌入式处理器(2)的主存储器(11)的数据之间进行切换。

3.根据权利要求1所述的大容量存储系统(1),其中,所述大容量存 储阵列(10)包括两个或更多的存储单元(9)。

4.根据权利要求3所述的大容量存储系统(1),其中,所述两个或更 多的存储单元(9)为硬盘、光盘、或固态存储器。

5.根据权利要求3所述的大容量存储系统(1),其进一步具有数据处 理块(8),所述数据处理块(8)用于拆分数据流并且并行地将其发送给所 述两个或更多的存储单元(9)。

6.根据权利要求1至5中的任一项所述的大容量存储系统(1),其中 为SRAM或DRAM数据缓冲器(7)设置阈值,所述阈值控制从SRAM或 DRAM数据缓冲器(7)向大容量存储阵列(10)、向实时数据接口(3)、或 向主存储器(11)流传输出数据的瞬时。

7.根据权利要求6所述的大容量存储系统(1),其中为向大容量存储 阵列(10)、向实时数据接口(3)、以及向主存储器(11)的数据传输设置 不同的阈值。

8.一种在大容量存储系统(1)中的数据传输的方法,所述大容量存储 系统(1)具有:实时数据接口(3)和大容量存储阵列(10)之间的第一数 据通道,所述第一数据通道包括SRAM或DRAM数据缓冲器(7),其充当 用于实时数据接口(3)和大容量存储阵列(10)之间的实时高数据速率数 据传输的缓冲器;以及嵌入式处理器(2)和大容量存储阵列(10)之间的 第二数据通道,所述方法具有以下步骤:使用SRAM或DRAM数据缓冲器 (7)执行在所述嵌入式处理器(2)的主存储器(11)和所述大容量存储阵 列(10)之间的非实时数据传输。

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