[发明专利]控制互连线之间介质层中空洞高度的方法无效
申请号: | 200910057406.2 | 申请日: | 2009-06-11 |
公开(公告)号: | CN101924060A | 公开(公告)日: | 2010-12-22 |
发明(设计)人: | 彭虎;谢烜;程晓华;彭仕敏 | 申请(专利权)人: | 上海华虹NEC电子有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 丁纪铁 |
地址: | 201206 上*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 控制 互连 之间 介质 空洞 高度 方法 | ||
1.一种控制互连线之间介质层中空洞高度的方法,其特征在于,在形成互连线之后,包括以下步骤:
1)采用PECVD淀积SiO2,使得一部分互连线之间形成闭合空洞,另一部分互连线之间形成未闭合的空洞;
2)采用HDPCVD淀积SiO2,填充步骤1)中未闭合的空洞,使所有空洞顶部高度不超过较小间距互连线之间最高空洞顶部高度。
2.根据权利要求1所述的控制互连线之间介质层中空洞高度的方法,其特征在于,步骤2)中将未闭合的空洞填充满,或者在原未闭合的空洞底部留下部分空洞,或者是上述两种情况的结合。
3.根据权利要求1所述的控制互连线之间介质层中空洞高度的方法,其特征在于,步骤1)为采用PECVD淀积SiO2,使得一部分互连线之间形成闭合空洞,另一部分互连线之间形成未闭合的空洞,并控制闭合空洞的高度符合预先设定的范围。
4.根据权利要求2所述的控制互连线之间介质层中空洞高度的方法,其特征在于,步骤2)中采用HDPCVD淀积SiO2,填充在步骤1)中未闭合的空洞,并在原未闭合的空洞底部留下部分空洞时,控制在原未闭合的空洞底部留下部分空洞高度在预先设定的范围。
5.根据权利要求1或2所述的控制互连线之间介质层中空洞高度的方法,其特征在于,所述的互连线为金属或金属合金互连线,如铝、铝硅、铜、钨,或者是金属化合物互连线,如氮化钛,钨化硅,或者是多晶硅、非晶硅互连线。
6.根据权利要求1或2所述的控制互连线之间介质层中空洞高度的方法,其特征在于,步骤1)中采用PECVD淀积SiO2,采用TEOS工艺,或者使用SiH4工艺。
7.根据权利要求1所述的控制互连线之间介质层中空洞高度的方法,其特征在于,步骤1)完成后,在一部分互连线之间形成闭合空洞,其连线之间间距为90-300纳米,在另一部分互连线之间形成未闭合的空洞,其连线之间间距大于300纳米。
8.根据权利要求3所述的控制互连线之间介质层中空洞高度的方法,其特征在于,闭合空洞顶部距离介质层表面高度为10-1000埃。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造