[发明专利]UMOS器件及其形成方法无效
申请号: | 200910199226.8 | 申请日: | 2009-11-20 |
公开(公告)号: | CN102074477A | 公开(公告)日: | 2011-05-25 |
发明(设计)人: | 陈德艳;郑大燮 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/78 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 李丽 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | umos 器件 及其 形成 方法 | ||
1.一种UMOS器件形成方法,其特征在于,包括:
提供衬底,所述衬底为n+型衬底;
在所述衬底表面形成n外延层;
在所述n外延层内形成位于所述n外延层表面侧的p阱;
在所述n外延层和p阱内形成贯穿所述n外延层且位于p阱内的沟槽;
在所述沟槽底部和沟槽侧壁以及部分p阱与所述沟槽侧壁相邻的表面形成栅介质层;
在所述栅介质层表面形成栅电极层且所述栅电极层填充所述沟槽;
在p阱内形成源极区和体区,所述源极区与栅介质层相邻。
2.如权利要求1所述的UMOS器件形成方法,其特征在于,在所述沟槽底部和沟槽侧壁以及与所述沟槽侧壁相邻的p阱表面形成栅介质层和在所述介质层表面形成填充所述沟槽的栅电极层具体步骤包括:在所述沟槽底部和沟槽侧壁以及p阱表面形成栅介质薄膜;在所述栅介质薄膜上形成填充所述沟槽的栅电极层薄膜;在所述栅电极层薄膜表面形成与栅电极层对应的光刻胶图形;以所述光刻胶图形为掩膜,依次刻蚀栅电极层薄膜和栅介质薄膜,形成栅电极层和栅介质层。
3.如权利要求1所述的UMOS器件形成方法,其特征在于,所述栅电极层材料为多晶硅或者导电金属材料。
4.如权利要求1所述的UMOS器件形成方法,其特征在于,所述栅介质层材料为氧化硅或者氮化硅。
5.如权利要求1所述的UMOS器件形成方法,其特征在于,所述n外延层的离子浓度要低于n+型衬底的离子浓度。
6.一种UMOS器件,其特征在于,包括:
n+型衬底;
形成在n+型衬底表面的n外延层;
形成在n外延层表面的p阱;
贯穿所述n外延层且位于p阱内的沟槽;
形成在所述沟槽底部和沟槽侧壁以及部分p阱与所述沟槽侧壁相邻的表面的栅介质层;
形成在所述栅介质层表面的栅电极层且所述栅电极层填充所述沟槽;
形成在p阱内的源极区和体区,且所述源极区与栅介质层相邻。
7.如权利要求6所述的UMOS器件,其特征在于,所述栅电极层材料为多晶硅或者导电金属材料。
8.如权利要求6所述的UMOS器件,其特征在于,所述栅介质层材料为氧化硅或者氮化硅。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造