[发明专利]数字逻辑电路、移位寄存器、以及有源矩阵器件有效

专利信息
申请号: 200980113748.X 申请日: 2009-03-27
公开(公告)号: CN102007692A 公开(公告)日: 2011-04-06
发明(设计)人: P·泽贝迪;J·瑞简德拉 申请(专利权)人: 夏普株式会社
主分类号: H03K3/356 分类号: H03K3/356;G09G3/20;G09G3/36
代理公司: 上海专利商标事务所有限公司 31100 代理人: 张鑫
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 数字 逻辑电路 移位寄存器 以及 有源 矩阵 器件
【说明书】:

技术领域

本发明涉及数字逻辑电路,并涉及包括这种电路的移位寄存器和有源矩阵器件。这种电路可例如用作适用于在时钟发生器中驱动有源矩阵显示器的行和/或列的触发器。

背景技术

附图的图1示出典型的有源矩阵显示器。这种显示器由排列成M行N列的图元(像素)矩阵2构成。每行和每列被连接至一电极,且列电极连接至数据驱动电路4的N个输出,而行电极连接至扫描驱动电路6的M个输出。

像素被每次一行地寻址。扫描驱动电路包括M相时钟发生器,其产生如附图的图2所示的一串时钟脉冲。每个时钟脉冲输出i控制行i的激活,对于每个i使1≤i≤M。脉冲通常是非交叠的,从而不会有两个脉冲同时为高。

一行中的所有像素可同时被寻址,或者它们可分B个b像素的块寻址,其中bB=N。在后一情形中,数据驱动电路也可包括所述类型的B相时钟发生器,从而每个时钟脉冲输出i激活块i,对于每个i使1≤i≤B。

显示器的正常操作使得数据对应于图2所示的时序、从上到下从左到右地采样到像素上。然而,通常的要求是采样的方向是可切换的,以使数据被从下到上和/或从左到右地采样到像素上。这样,有可能反映或旋转所显示的图像而无需对输入数据重新排序。这种重新排序需要相当多的附加电路系统,诸如足以储存整个图像的附加存储器。

在此情形中,时钟发生器必须另外能够双向运算,从而产生如附图图2所示的时钟脉冲或附图图3所示类型的时钟脉冲。图3中的每个脉冲输出i(对于每个i使得1≤i≤M)仍然激活行i。然而,脉冲输出i出现在脉冲输出i-1之前,而在图2中脉冲输出i出现在脉冲输出i-1之后。

所述类型的扫描驱动电路可直接在显示器衬底上形成,从而减少显示器所需的连接的数量。这是有利的,因为减少了连接器所占用的面积,并且使显示器更为机械稳健。在这些情形中,通常将单种类型的晶体管用于时钟发生器电路。例如,该电路可仅由n型晶体管构成,而不是如CMOS电路中常用的n型和p型晶体管的混合。单种类型的晶体管的使用对于制造成本而言是有益的。然而,使用单种类型的晶体管来设计诸如与门和逆变器的低功率高速逻辑是困难的。

在扫描驱动电路中使用的时钟发生器可由移位寄存器形成。移位寄存器是能够响应于时钟信号沿其长度从一级到另一级地使数据列顺序移位的多级电路。一般而言,移位寄存器可使任意的数据序列移位。然而,当移位寄存器被用作扫描或数据驱动电路中的时钟发生器时,仅需沿其长度移动单个高态。这种移位寄存器被称为“移一步”(walking one)移位寄存器,并且可能能够或者可能不能使任意的数据列移位。

这种类型的时钟发生器的一个示例在美国专利6377099中公开,并且在附图的图4中示出。每一级由重置-置位(RS)锁存器24和用于控制时钟的传递的附加门26构成,从而在RS锁存器被置位时时钟被传递至该级的输出,而在RS锁存器被重置时输出被拉至无效状态。该门的输出被连接至下一级的置位输入,并连接至前一级的重置输入。该门的输出也构成扫描驱动电路的输出。

此外,美国专利No.6724361描述使用非交叠时钟的类似时钟发生器。

RS锁存器是众所周知的逻辑块。如图4所示,其具有置位输入S和重置输入R,以及两个输出Q和QB,其中QB是Q的逻辑补。其根据以下真值表1工作:

表1

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