[发明专利]数据传输方法与数据传输结构无效
申请号: | 201010000622.6 | 申请日: | 2010-01-12 |
公开(公告)号: | CN102122480A | 公开(公告)日: | 2011-07-13 |
发明(设计)人: | 施俊任 | 申请(专利权)人: | 瑞鼎科技股份有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20;G09G3/32;G09G3/36 |
代理公司: | 北京康信知识产权代理有限责任公司 11240 | 代理人: | 吴贵明;张英 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 数据传输 方法 结构 | ||
1.一种数据传输结构,耦接数据模块,所述数据传输结构包含:
输入缓冲层,所述输入缓冲层包含N个依序串接的输入锁存器,所述输入缓冲层中第1个输入锁存器耦接至所述数据模块,其中N为自然数;以及
输出缓冲层,所述输出缓冲层包含N个依序串接的输出锁存器,所述输出缓冲层中第1个输出锁存器耦接至所述输入缓冲层中第N个输入锁存器;
其中,当所述输入缓冲层被开启时,所述数据模块中的N笔数据依序被读入所述输入缓冲层中的第N个输入锁存器至第1个输入锁存器中,随后通过控制这些输入锁存器与这些输出锁存器的启闭状态依序将所述N个输入锁存器中的所述N笔数据被传输至所述输出缓冲层中的所述N个输出锁存器,随后所述N笔数据依序被传输至所述输出缓冲层的第N个输出锁存器并经由所述第N个输出锁存器输出。
2.根据权利要求1所述的数据传输结构,其中,进一步包含控制模块,所述控制模块分别耦接至所述输入缓冲层以及所述输出缓冲层,所述控制模块用以控制这些输入锁存器以及这些输出锁存器的启闭状态。
3.根据权利要求2所述的数据传输结构,当所述N笔数据的其中一笔数据被读入所述输入缓冲层中时,所述控制模块开启所述输入缓冲层中的第1个输入锁存器至第x个所述输入锁存器,由此,使所述笔数据经过第1个输入锁存器至第x-1个输入锁存器并写入至第x个输出锁存器,其中x为介于2到N之间的整数。
4.根据权利要求2所述的数据传输结构,当所述N笔数据的其中一笔数据由所述输入缓冲层的第x个输入锁存器中被传输至所述输出缓冲层中的第x个输出锁存器时,所述控制模块开启所述输出缓冲层中的第x+1个输入锁存器至第N个输入锁存器且同时开启所述输出缓冲层中的第1个输出锁存器至第x个所述输出锁存器,由此,使所述笔数据经过第x+1个输入锁存器至第N个输入锁存器与第1个输出锁存器至第x-1个所述输出锁存器,并传输至所述第x个输出锁存器,其中x为介于1到N-1之间的整数。
5.根据权利要求2所述的数据传输结构,当所述N笔数据依序经由第N个输出锁存器输出之前,所述控制模块开启所述输出缓冲层中的第x+1个输出锁存器至第N个输出锁存器,由此,暂存于第x个输入锁存器的其中一笔数据经过第x+1个输出锁存器至第N-1个输出锁存器,进而由第N个输出锁存器输出。
6.一种数据传输方法,适用于数据传输结构,所述数据传输结构包含输入缓冲层以及输出缓冲层,所述输入缓冲层包含N个依序串接的输入锁存器,所述输出缓冲层包含N个依序串接的输出锁存器,其中所述输入缓冲层中第1个输入锁存器耦接至数据模块,所述输出缓冲层中第1个输出锁存器耦接至所述输入缓冲层中第N个输入锁存器,所述数据传输方法包含下列步骤:
(a)开启所述输入缓冲层,将所述数据模块中的N笔数据依序读入所述输入缓冲层中的第N个输入锁存器至第1个输入锁存器中;
(b)控制这些输入锁存器与这些输出锁存器的启闭状态,依序将所述N个输入锁存器中的所述N笔数据传输至所述输出缓冲层中的所述N个输出锁存器;以及
(c)使所述N笔数据依序被传输至所述输出缓冲层的第N个输出锁存器并经由所述第N个输出锁存器输出。
7.根据权利要求6所述的数据传输方法,其中,步骤(b)中所述N笔数据的其中一笔数据由所述输入缓冲层的第x个输入锁存器中被传输至所述输出缓冲层中的第x个输出锁存器时,通过下列步骤完成:
(b1)开启所述输出缓冲层中的第x+1个输入锁存器至第N个输入锁存器且同时开启所述输出缓冲层中的第1个输出锁存器至第x个所述输出锁存器,由此,使所述笔数据经过第x+1个输入锁存器至第N个输入锁存器与第1个输出锁存器至第x-1个所述输出锁存器,并传输至所述第x个输出锁存器,其中x为介于1到N-1之间的整数。
8.根据权利要求6所述的数据传输方法,其中,步骤(c)通过下列步骤完成:
(c1)开启所述输出缓冲层中的第x+1个输出锁存器至第N个输出锁存器,由此,所述N笔数据中暂存于第x个输入锁存器的其中一笔数据经过第x+1个输出锁存器至第N-1个输出锁存器,进而由第N个输出锁存器输出。
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