[发明专利]一种SiC MESFET栅极制作方法有效
申请号: | 201010129557.7 | 申请日: | 2010-03-23 |
公开(公告)号: | CN101807527A | 公开(公告)日: | 2010-08-18 |
发明(设计)人: | 商庆杰;霍玉柱;潘宏菽;李亚丽;周瑞 | 申请(专利权)人: | 中国电子科技集团公司第十三研究所 |
主分类号: | H01L21/338 | 分类号: | H01L21/338;H01L21/28 |
代理公司: | 石家庄国为知识产权事务所 13120 | 代理人: | 李荣文 |
地址: | 050051 *** | 国省代码: | 河北;13 |
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摘要: | |||
搜索关键词: | 一种 sic mesfet 栅极 制作方法 | ||
技术领域
本发明涉及一种半导体器件制备工艺,尤其涉及一种SiC MESFET(SiC金属-半导体场效应晶体管)栅极制作方法。
背景技术
碳化硅(SiC)是一种发展迅速的半导体材料,具有比硅和砷化镓更高性能的半导体特性,被人们称为继硅和砷化镓之后的“第三代半导体”,在半导体器件制备方面具有广阔的前景。
SiC可用来制作金属MESFET产品,为使MESFET工作正常,其栅极必须和沟道区形成肖特基接触,场效应晶体管的夹断电压直接取决于该肖特基接触的势垒电压。另外,在SiC MESFET制作工艺中,栅极的制作至关重要,它关系到整个器件的最终性能。
SiC在常温下很难被腐蚀,通用的刻蚀方法都是等离子体干法刻蚀。由于等离子体刻蚀会损伤SiC表面,使界面粗糙,界面态密度增大,因此导致器件性能下降;而且只要等离子体接触到SiC表面就会有材料被溅射出来,因此在圆片表面会发现Fe、Ni等杂质。损伤和污染都会对肖特基接触产生影响,会使理想因子变大,势垒高度下降,从而影响器件的性能。
发明内容
本发明要解决的技术问题是:在对氧化硅层进行氮化处理后通过增加湿法再氧化工艺,对已经生成氮氧化硅层的氧化硅层进行进一步氮化处理,以解决SiC MESFET界面态密度大、肖特基势垒高度低、器件性能差的问题。
为解决上述技术问题,本发明所采取的技术方案是:一种SiC MESFET栅极制作方法,包括以下步骤:
1)在SiC衬底上通过同质外延制备出缓冲层、沟道层、盖帽层;
2)在盖帽层上生长掩蔽层,光刻、刻蚀掩蔽层形成栅区;
3)去除掩蔽层,干法刻蚀掉栅区处盖帽层;
4)在栅区处沟道层表面进行氧化,并腐蚀氧化层以去除SiC损伤层;
5)在栅区处沟道层表面进行热氧化生成氧化硅层;
6)对氧化硅层进行氮化处理生成氮氧化硅层;
7)涂敷光刻胶,曝光、显影后形成栅区窗口;
8)湿法刻蚀栅区氮氧化硅层;
9)蒸发淀积金属形成栅极;
其中:在上述步骤6)和步骤7)之间增加采用湿法再氧化工艺对氮氧化硅层进行进一步氮化处理的步骤。
作为本发明进一步改进的技术方案,在上述湿法再氧化后的氮氧化硅层上淀积氮化硅层,并且在上述步骤7)和步骤8)之间增加干法刻蚀栅区氮化硅层的步骤。
采用上述技术方案所产生的有益效果在于:由于在SiC界面处存在悬挂键,在高温NH3或NO或NO2气氛下进行氮化处理,可以饱和部分悬挂键,以降低SiC的界面态密度;另外,在湿法再氧化时通入含体积比为5%~20%的HNO3水汽,HNO3水汽在高温下可分解为NO或NO2,由于湿法氧化有更高的扩散速率,这就可以进一步将NO或NO2带入SiC界面,因此进一步降低了界面态密度,从而降低了理想因子,提高了肖特基势垒的高度和耐击穿电压,提高了器件的性能。
本发明所产生的进一步的有益效果在于:在上述湿法再氧化的氮氧化硅层上淀积的氮化硅层能保证栅极形貌,避免用湿法刻蚀氮氧化硅层时对栅极形貌造成破坏,提高了栅极的稳定性和可靠性,保证栅长的实际值不偏离设计值,对提高耐击穿电压也有辅助作用。按照栅长0.5μm设计,传统的制作方法栅长实际值一般为0.65μm,偏差大于20%;采用该技术后栅长一般小于0.55μm,偏差小于10%;击穿电压也可以从原来的80V提高到100V以上。
附图说明
图1是在盖帽层上生长掩蔽层,光刻、刻蚀掩蔽层形成栅区的截面示意图;
图2是干法刻蚀掉栅区处盖帽层,并氧化去除SiC损伤层后的截面示意图;
图3是热氧化SiC层生成氧化硅层的截面示意图;
图4是氮化氧化硅层生成氮氧化硅层,并对氮氧化硅层湿法再氧化的截面示意图;
图5是在氮氧化硅层上淀积氮化硅层的截面示意图;
图6是光刻栅区、干法刻蚀氮化硅层、湿法刻蚀氮氧化硅层后的截面示意图;
图7是蒸发淀积金属后制备出栅极的截面示意图。
其中,1-SiC衬底,2-缓冲层,3-沟道层,4-盖帽层,5-掩蔽层,6-氧化硅层,7-氮氧化硅层,8-氮化硅层,9-光刻胶,10-栅极。
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