[发明专利]数据同步处理系统及方法无效
申请号: | 201010511732.9 | 申请日: | 2010-10-19 |
公开(公告)号: | CN102457267A | 公开(公告)日: | 2012-05-16 |
发明(设计)人: | 王振华;唐佩忠 | 申请(专利权)人: | 鸿富锦精密工业(深圳)有限公司;鸿海精密工业股份有限公司 |
主分类号: | H03K19/096 | 分类号: | H03K19/096 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 518109 广东省深圳市*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 数据 同步 处理 系统 方法 | ||
1.一种数据同步处理系统,包括被提供第一时钟的第一同步逻辑电路及被提供采样时钟的第二同步逻辑电路,该采样时钟与第一时钟的频率相同且存在相位差,该第一同步逻辑电路用于产生在第一时钟的上升沿或下降沿发生改变的第一数据,其特征在于:该数据同步处理系统还包括同步处理电路,该同步处理电路用于对第一数据进行处理,以产生与采样时钟的上升沿或下降沿同步的第二数据,该第二同步逻辑电路利用采样时钟对第二数据进行采样。
2.如权利要求1所述的数据同步处理系统,其特征在于:该同步处理电路包括第一采样电路、第二采样电路和采样合成电路,该第一采样电路和第二采样电路均利用第一时钟对第一数据进行采样以分别产生第三数据和第四数据,该采样合成电路利用采样时钟的上升沿或下降沿依次对第三数据和第四数据进行采样以合成该第二数据。
3.如权利要求2所述的数据同步处理系统,其特征在于:该同步处理电路还包括除频器,该除频器用于对所述第一时钟进行除频处理以产生第二时钟,该第一数据在第一时钟的下降沿发生改变,该第一采样电路利用第一时钟的上升沿对第一数据进行采样,并在第二时钟处于第一电平时将第一数据分配给第三数据,该第二采样电路利用第一时钟的上升沿对第一数据进行采样,并在第二时钟处于第二电平时将第一数据分配给第四数据。
4.如权利要求2所述的数据同步处理系统,其特征在于:该同步处理电路还包括除频器,该除频器用于对所述第一时钟进行除频处理以产生第二时钟,该第一数据在第一时钟的上升沿发生改变,该第一采样电路利用第一时钟的下降沿对第一数据进行采样,并在第二时钟处于第一电平时将第一数据分配给第三数据,该第二采样电路利用第一时钟的下降沿对第一数据进行采样,并在第二时钟处于第二电平时将第一数据分配给第四数据。
5.如权利要求3或4所述的数据同步处理系统,其特征在于:该第一时钟的频率为第二时钟的两倍。
6.一种数据同步处理方法,其包括以下步骤:
提供在第一时钟的上升沿或下降沿发生改变的第一数据;
对第一数据进行处理,以产生与采样时钟的上升沿或下降沿同步的第二数据,该采样时钟与所述第一时钟的频率相同且存在相位差;
利用采样时钟对第二数据进行采样。
7.如权利要求6所述的数据同步处理方法,还包括:
利用第一时钟对第一数据进行采样以分别产生第三数据和第四数据;
利用采样时钟对第三数据和第四数据进行采样以合成该第二数据。
8.如权利要求6所述的数据同步处理方法,还包括:
对所述第一时钟进行除频处理以产生第二时钟,该第一数据在第一时钟的下降沿发生改变;
利用第一时钟的上升沿对第一数据进行采样,在第二时钟处于第一电平时将第一数据分配给第三数据,并在第二时钟处于第二电平时将第一数据分配给第四数据。
9.如权利要求6所述的数据同步处理方法,还包括:
对所述第一时钟进行除频处理以产生第二时钟,该第一数据在第一时钟的上升沿发生改变;
利用第一时钟的下降沿对第一数据进行采样,在第二时钟处于第一电平时将第一数据分配给第三数据,并在第二时钟处于第二电平时将第一数据分配给第四数据。
10.如权利要求8或9所述的数据同步处理方法,其特征在于:该第一时钟的频率为第二时钟的两倍。
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