[发明专利]保持触发器有效
| 申请号： | 201010528756.5 | 申请日： | 2010-11-01 |
| 公开（公告）号： | CN102215033A | 公开（公告）日： | 2011-10-12 |
| 发明（设计）人： | 汲世安;沈学聪;李芷岩;李云汉 | 申请（专利权）人： | 台湾积体电路制造股份有限公司 |
| 主分类号： | H03K3/012 | 分类号： | H03K3/012;H03K19/094 |
| 代理公司： | 北京市德恒律师事务所 11306 | 代理人： | 陆鑫;熊须远 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | |||
| 搜索关键词： | 保持 触发器 | ||
1.一种主从保持触发器，包括：
主锁存器，用于锁存输入数据信号并基于输入时钟信号输出锁存的主锁存器数据信号；
从锁存器，与所述主锁存器的输出端相连接，并用于基于所述输入时钟信号输出锁存的从锁存器数据信号；以及
保持锁存器，嵌入所述主锁存器和所述从锁存器之一中，用于基于断电控制信号在断电模式下保存数据。
2.根据权利要求1所述的触发器，其中，所述触发器包括由虚拟VDD电源供电的第一组器件，以及由恒定VDD电源供电的第二组器件。
3.根据权利要求2所述的触发器，其中，所述保持锁存器嵌入所述从锁存器中，所述主锁存器只包括选自所述第一组器件中的器件，并且所述从锁存器包括选自所述第一组器件和所述第二组器件中的器件。
4.根据权利要求2所述的触发器，其中，所述保持锁存器嵌入所述主锁存器中，所述从锁存器只包括选自所述第一组器件中的器件，并且所述主锁存器包括选自所述第一组器件和所述第二组器件中的器件。
5.根据权利要求1所述的触发器，其中，嵌入有所述保持锁存器的所述主锁存器或所述从锁存器包括在正常操作模式期间可操作的主存储器环以及在所述断电模式期间可操作的次存储器环，其中，所述主存储器环和所述次存储器环共享至少一个器件，至少一个共享的器件是反相器。
6.根据权利要求5所述的触发器，
其中，所述主存储器环包括第一反相器和第二反相器，连接在所述第一反相器的输出端和所述第二反相器的输入端之间的第一通过门以及连接在所述第二反相器的输出端和所述第一反相器的输入端之间的第二通过门，其中，所述第一通过门通过所述断电控制信号进行控制，以及所述第二通过门通过所述输入时钟信号进行控制，以及
其中，所述次存储器环包括所述第二反相器、输入端连接到所述第二反相器的输出端的第三反相器以及连接在所述第三反相器的输出端和所述第二反相器的输入端之间的第三通过门，其中，所述第三通过门通过所述断电控制信号进行控制。
其中，所述主存储器环进一步包括第四反相器和第五反相器，所述第四反相器连接在所述第一反相器的输出端和所述第二反相器的输入端之间，以及所述第五反相器连接在所述第二反相器的输出端和所述第一反相器的输入端之间。
7.一种主从保持触发器，包括：
主锁存器，用于锁存输入数据信号，并基于输入时钟信号输出锁存的主锁存器数据信号；
从锁存器，连接到所述主锁存器的输出端，并用于基于所述输入时钟信号输出锁存的从锁存器数据信号；以及
保持锁存器，嵌入所述主锁存器和所述从锁存器之一中，并用于基于断电控制信号在断电模式下保存数据，
其中，所述触发器包括通过虚拟VDD电源供电的第一组器件以及通过常开VDD电源供电的第二组器件，
其中，具有嵌入的保持锁存器的主锁存器或从锁存器包括选自所述第一组器件和所述第二组器件的器件，并且其他主锁存器和从锁存器仅包括选自所述第一组器件的器件，并且
其中，所述输入时钟信号在断电模式期间无效。
8.根据权利要求7所述的触发器，其中，具有嵌入的保持锁存器的主锁存器或从锁存器包括在正常操作模式期间可操作的主存储器环以及在所述断电模式期间可操作的次存储器环，其中，所述主存储器环和所述次存储器环共享至少一个器件，所述至少一个共享的器件是选自所述第二组器件的器件。
9.根据权利要求7所述的触发器，其中，所述主锁存器和所述从锁存器中的每一个都包括具有用于接收数据设置信号的输入端的逻辑门以及具有用于接收数据复位信号的输入端的逻辑门中的一个或两个。
10.一种主从保持触发器，包括：
主锁存器，用于锁存输入数据信号，并基于输入时钟信号输出锁存的主锁存器数据信号；
从锁存器，连接到所述主锁存器的输出端，并用于基于所述输入时钟信号输出锁存的从锁存器数据信号；以及
保持锁存器，嵌入到所述主锁存器和所述从锁存器之一中，并用于基于断电控制信号在断电模式下保存数据，
其中，所述触发器包括通过虚拟VDD电源供电的第一组器件以及通过常开VDD电源供电的第二组器件；
其中，具有嵌入的保持锁存器的主锁存器或从锁存器包括选自所述第一组器件和所述第二组器件的器件，并且其他主锁存器和从锁存器仅包括选自所述第一组器件的器件，并且
其中，具有嵌入的保持锁存器的主锁存器或从锁存器包括在正常操作模式期间可操作的主存储器电路以及在所述断电模式期间可操作的次存储器电路，其中，所述主存储器电路和所述次存储器电路共享至少一个器件，所述至少一个共享的器件是选自所述第二组器件的器件。
其中，所述主存储器电路包括连接成环的第一反相器和第二反相器、连接在所述第一反相器的输出端和所述第二反相器的输入端之间的第一通过门、以及连接在所述第二反相器的输出端和所述第一反相器的输入端之间的第二通过门，其中，所述第一通过门通过所述断电控制信号进行控制，以在所述正常操作模式期间传送数据，并且所述第二通过门通过所述输入时钟信号进行控制，以及
其中，所述次存储器电路包括所述第二反相器、输入端连接到所述第二反相器的输出端的第三反相器、以及连接在所述第三反相器的输出端和所述第二反相器的输入端之间的第三通过门，其中，所述第三通过门通过所述断电控制信号进行控制，以在断电模式期间传送数据，所述至少一个共享的器件是所述第二反相器。
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