[发明专利]执行对两个操作数的操作并随后存储原始值的方法和系统无效

专利信息
申请号: 201110168746.X 申请日: 2011-06-22
公开(公告)号: CN102298515A 公开(公告)日: 2011-12-28
发明(设计)人: 丹.F.格雷纳;马塞尔.米特兰;蒂莫西.J.斯莱格尔 申请(专利权)人: 国际商业机器公司
主分类号: G06F9/30 分类号: G06F9/30;G06F9/34;G06F9/318
代理公司: 北京市柳沈律师事务所 11105 代理人: 邸万奎
地址: 美国纽*** 国省代码: 美国;US
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摘要:
搜索关键词: 执行 两个 作数 操作 随后 存储 原始 方法 系统
【权利要求书】:

1.一种计算机实施的方法,用于执行具有互锁存储器操作数的算术/逻辑指令,所述算术/逻辑指令包括操作码字段、指定第一寄存器中的第一操作数的第一寄存器字段、指定第二寄存器的第二寄存器字段、以及指定第三寄存器的第三寄存器字段,所述第二寄存器指定第二操作数在存储器中的位置,所述算术/逻辑指令的执行包括:

由处理器从由所述第二寄存器指定的存储器中的位置获得第二操作数,所述第二操作数由值组成;

从所述第三寄存器获得第三操作数;

基于所获得的第二操作数和所获得的第三操作数执行操作码定义的算术运算或逻辑运算以产生结果;

将所产生的结果存储在存储器中的所述位置中;以及

将所获得的第二操作数的值保存在所述第一寄存器中。

2.如权利要求1所述的方法,还包括保存条件码,所述条件码指示所述结果为零或者所述结果为非零。

3.如权利要求2所述的方法,其中所述操作码定义的算术运算是算术或逻辑ADD,并且其中所述操作码定义的逻辑运算是“与”、“异或”或者“或”中的任一个,所述方法还包括:

响应于所述逻辑运算的结果为负,保存指示所述结果为负的条件码;

响应于所述逻辑运算的结果为正,保存指示所述结果为正的条件码;以及

响应于所述逻辑运算的结果为溢出,保存指示所述结果为溢出的条件码。

4.如权利要求3所述的方法,其中操作数大小由操作码指定,其中一个或多个第一操作码指定32位操作数,并且一个或多个第二操作码指定64位操作数。

5.如权利要求4所述的方法,其中所述算术/逻辑指令还包括由两个单独的操作码字段组成的操作码、第一位移字段和第二位移字段,其中通过将所述第二寄存器的内容加至带符号的位移值而确定存储器中的所述位置,所述带符号的位移值包括链接至所述第二位移字段的第一位移字段的符号扩展值。

6.如权利要求5所述的方法,还包括:

响应于所述操作码是第一操作码并且所述第二操作数不在32位边界上,生成规范异常;以及

响应于所述操作码是第二操作码并且所述第二操作数不在64位边界上,生成规范异常。

7.如权利要求6所述的方法,其中所述处理器是多处理器系统中的处理器,所述方法还包括:

所述获得第二操作数包括防止所述多处理器系统的其它处理器在所述获得第二操作数与将结果存储在存储器中的第二位置处之间访问存储器中的所述位置;以及

在所述存储所产生的结果时,允许所述多处理器系统的其它处理器访问存储器中的所述位置。

8.一种计算机系统,用于执行具有互锁存储器操作数的算术/逻辑指令,所述算术/逻辑指令包括操作码字段、指定第一寄存器中的第一操作数的第一寄存器字段、指定第二寄存器的第二寄存器字段、以及指定第三寄存器的第三寄存器字段,所述第二寄存器指定第二操作数在存储器中的位置,所述计算机系统包括:

存储器;以及

与所述存储器通信的处理器,所述处理器包括用于从存储器取出指令的指令取出单元以及用于执行所取出的指令的一个或多个执行单元,其中所述计算机系统被配置为执行用于执行所述算术/逻辑运算的方法,所述方法包括:

由处理器从由所述第二寄存器指定的存储器中的位置获得第二操作数,所述第二操作数由值组成;

从所述第三寄存器获得第三操作数;

基于所获得的第二操作数和所获得的第三操作数执行操作码定义的算术运算或逻辑运算以产生结果;

将所产生的结果存储在存储器中的所述位置中;以及

将所获得的第二操作数的值保存在所述第一寄存器中。

9.如权利要求8所述的计算机系统,还包括保存条件码,所述条件码指示所述结果为零或者所述结果为非零。

10.如权利要求9所述的计算机系统,其中所述操作码定义的算术运算是算术或逻辑“加”,其中所述操作码定义的逻辑运算是“与”、“异或”或者“或”中的任一个,所述计算机系统还包括:

响应于所述逻辑运算的结果为负,保存指示所述结果为负的条件码;

响应于所述逻辑运算的结果为正,保存指示所述结果为正的条件码;以及

响应于所述逻辑运算的结果为溢出,保存指示所述结果为溢出的条件码。

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