[发明专利]一种格雷码编解码并行电路在审
| 申请号： | 201110211127.4 | 申请日： | 2011-07-26 |
| 公开（公告）号： | CN102904584A | 公开（公告）日： | 2013-01-30 |
| 发明（设计）人： | 左耀华 | 申请（专利权）人： | 上海华虹集成电路有限责任公司 |
| 主分类号： | H03M13/15 | 分类号： | H03M13/15 |
| 代理公司： | 上海浦一知识产权代理有限公司 31211 | 代理人： | 丁纪铁 |
| 地址： | 201203 上海市*** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 一种 格雷码编 解码 并行 电路 | ||
【权利要求书】：
1.一种格雷码编解码并行电路，包括：
N个二选一选择器和N+1个异或运算单元，一个二选一选择器和一个异或运算单元组成一个数据选择及运算的基本单元；
二选一选择器受控制信号控制为异或运算单元选择输入数据，第M个二选一选择器接收外部数据和第M+1个异或运算单元的输出数据，二选一选择器由控制信号控制选择数据并输出给其对应的异或运算单元，M≤N；
第N+1个异或运算单元接收外部数据，进行异或运算并输出异或运算结果；
其它异或运算单元接收外部数据和其各自对应的二选一选择器的输出数据，进行异或运算并输出异或运算结果。
2.如权利要求1所述的并行电路，其特征是：输入数据和输出数据的位宽为S比特，数据位宽S与二选一选择器个数N的关系为：S＝N+2。
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