[发明专利]相位调整电路、接收装置和通信系统无效

专利信息
申请号: 201110273987.0 申请日: 2011-09-15
公开(公告)号: CN102404101A 公开(公告)日: 2012-04-04
发明(设计)人: 田中智一;诸桥英雄;饭塚浩 申请(专利权)人: 索尼公司
主分类号: H04L7/00 分类号: H04L7/00
代理公司: 北京市柳沈律师事务所 11105 代理人: 周少杰
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 相位 调整 电路 接收 装置 通信 系统
【权利要求书】:

1.一种相位调整电路,包括:

串并转换部分,配置为响应于时钟,将包括插入预定位置的同步模式的串行数据转换为并行数据;

同步模式位置检测部分,配置为检测由所述串并转换部分生成的所述并行数据中的所述同步模式的位置;以及

调整部分,配置为根据关于所述同步模式的所述位置的信息,调整所述并行数据和所述时钟的相位,以符合由所述同步模式位置检测部分检测的、作为所述同步模式的所述位置的位置。

2.如权利要求1所述的相位调整电路,还包括

多相位时钟生成器,配置为基于提供到所述串并转换部分的时钟生成多个具有不同相位的时钟,其中

所述调整部分

从所述具有不同相位的时钟中,根据关于所述同步模式的所述位置的信息,选择具有最优相位的时钟,该最优相位符合由所述同步模式位置检测部分检测的、作为所述同步模式的所述位置的位置,以及

与所述选择的时钟一起,输出通过将所述并行数据与所述选择的时钟同步获得的数据。

3.如权利要求2所述的相位调整电路,其中:

所述串并转换部分包括

第一锁存部分,具有用于锁存和移位与第一时钟同步接收的所述串行数据的多个锁存器,以及

第二锁存部分,配置为与通过分割所述第一时钟的频率生成的第二时钟同步地,锁存在所述第一锁存部分的所述锁存器中锁存的数据,并且输出所述数据作为N条并行数据;以及

所述同步模式位置检测部分

检测由所述第二锁存部分输出的、所述N条并行数据中的任一是否包括所述同步模式,

根据关于包括所述同步模式的所述并行数据的检测结果,确定所述第二时钟的相位是超前或滞后,以及

输出同步模式位置信息到所述调整部分,以用作示出所述第二时钟的相位是超前还是滞后的信息。

4.如权利要求3所述的相位调整电路,其中

如果所述同步模式位置信息指示所述第二时钟的相位超前预定的超前量,则所述调整部分选择滞后对应于所述预定超前量的滞后量的时钟,以及

如果所述同步模式位置信息指示所述第二时钟的相位滞后预定的超前量,则所述调整部分选择超前对应于所述预定滞后量的超前量的时钟。

5.如权利要求3所述的相位调整电路,其中:

通过照原样维持所述N条并行数据的连续顺序,划界所述N条并行数据以形成多个顺序组,其每个包括所述N条并行数据中的一些连续的并行数据;以及

所述多相位时钟生成器生成多个时钟,其每个被分配给所述组的特定组,以便用作具有对所述特定组唯一的相位的时钟。

6.一种接收装置,包括:

相位调整电路,配置为执行功能以

接收通过数据传输线传播并且包括插入预定位置的同步模式的串行数据,

将所述输入的串行数据转换为并行数据,以及

根据关于从所述并行数据作为所述同步模式的位置获取的位置的信息,调整所述并行数据和时钟的相位,

其中,为了执行所述功能,所述相位调整电路包括

串并转换部分,配置为响应于所述时钟,将包括插入预定位置的同步模式的所述串行数据转换为所述并行数据;

同步模式位置检测部分,配置为检测由所述串并转换部分生成的所述并行数据中的所述同步模式的位置;以及

调整部分,配置为根据关于所述同步模式的所述位置的信息,调整所述并行数据和所述时钟的相位,以符合由所述同步模式位置检测部分检测的、作为所述同步模式的所述位置的位置。

7.如权利要求6所述的接收装置,其中:

所述相位调整电路还包括

多相位时钟生成器,配置为基于提供到所述串并转换部分的时钟生成具有不同相位的多个时钟,其中

所述调整部分

从所述具有不同相位的时钟中,根据关于所述同步模式的所述位置的信息,选择具有最优相位的时钟,该最优相位符合由所述同步模式位置检测部分检测的、作为所述同步模式的所述位置的位置,以及

与所述选择的时钟一起,输出通过将所述并行数据与所述选择的时钟同步获得的数据。

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