[发明专利]一种80G容量异步ODU0的交叉实现方法有效
| 申请号： | 201110401576.5 | 申请日： | 2011-12-06 |
| 公开（公告）号： | CN102413389A | 公开（公告）日： | 2012-04-11 |
| 发明（设计）人： | 钟永波;陈飞月;唐家武;杨名;叶波;王石磊;陈永州;海增强;盛朝阳;李光瑜 | 申请（专利权）人： | 烽火通信科技股份有限公司 |
| 主分类号： | H04Q11/00 | 分类号： | H04Q11/00 |
| 代理公司： | 北京捷诚信通专利事务所(普通合伙) 11221 | 代理人： | 魏殿绅;庞炳良 |
| 地址： | 430074 湖北省武*** | 国省代码： | 湖北;42 |
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| 摘要： | |||
| 搜索关键词： | 一种 80 容量 异步 odu0 交叉 实现 方法 | ||
1.一种80G容量异步ODU0的交叉实现方法，其特征在于：首先构建64路ODU0的同步化处理单元和64路同步化处理后的ODU0信号交叉输出模块；
所述同步化处理单元中包括64个同步处理模块，完成64路并行ODU0信号的同步化，所述64路并行ODU0信号为64路异步ODU0信号，64路并行ODU0信号包括：输入的64路异步ODU0信号以及相应的64路随路时钟信号；
64路异步ODU0信号和64路随路时钟信号分别经过64个同步处理模块后，将所有异步信号变为同一时钟域的信号，共64组信号，全部同步在时钟REF_CLK上，REF_CLK是本地参考时钟，也是所有ODU0信号需要同步输出的时钟；
然后在这一时钟域进行全交叉处理，最后将全交叉的数据经过后端成帧处理后数据输出；
所述完成64路并行ODU0信号的同步化的具体步骤为：
将同一路的异步ODU0信号和随路时钟信号同时送入一个同步处理模块。
2.如权利要求1所述的80G容量异步ODU0的交叉实现方法，其特征在于：在并行ODU0信号的同步化处理中，为了在输出端口无损伤的刻画出输入的数据，要求时钟REF_CLK比随路时钟信号ODU0_CLK稍快，这样通过增加数据使能的方式能够完全同步刻画输入的数据。
3.如权利要求1所述的80G容量异步ODU0的交叉实现方法，其特征在于：并行ODU0信号同步化后，按照同步电路设计方法进行交叉处理，只需满足同步设计的时序要求就能够正确的实现交叉功能，最后将交叉后的ODU0颗粒映射到ODU1、ODU2颗粒中，实现异步ODU1、ODU2信号中ODU0颗粒的全交叉功能。
4.如权利要求1或2或3所述的80G容量异步ODU0的交叉实现方法，其特征在于：在将异步信号变为同一时钟域的信号时，每一路异步ODU0信号在时钟域转换时产生数据使能信号。
5.如权利要求4所述的80G容量异步ODU0的交叉实现方法，其特征在于：在64路异步ODU0信号的同步化过程中，采用ODU2信号并行16比特传送的标称时钟作为参考时钟，时钟频率为156.832Mhz，具体步骤如下：
将64路ODU0信号通过FIFO模块进行同步化处理，在156.832Mhz的时钟域通过数据使能完全刻画155.520Mhz时钟域的异步ODU0数据，使所有的64路异步ODU0信号都同步到本地的参考时钟REF_CLK上，达到数据同步的功能；
同步后的每一路数据中增加一个数据使能信号ODU0_DATAOUT_EN，用来传递每路数据经过时钟域切换后原来的时钟信息。
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