[发明专利]信号处理装置和信号处理方法无效
申请号: | 201110434272.9 | 申请日: | 2011-12-15 |
公开(公告)号: | CN102571651A | 公开(公告)日: | 2012-07-11 |
发明(设计)人: | 日高伊佐夫 | 申请(专利权)人: | 索尼公司 |
主分类号: | H04L25/02 | 分类号: | H04L25/02 |
代理公司: | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人: | 宋鹤 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 信号 处理 装置 方法 | ||
1.一种信号处理装置,包括;
输入块,所述输入块被配置为接收预定数目的数据项目和第一使能信号,所述第一使能信号与第一时钟相同步并且在所述数据有效的区间中处于活动状态;
计数块,所述计数块被配置为利用比所述第一时钟快的第二时钟为参考,对所述第一使能信号不活动的区间中的时钟数进行计数;
使能信号控制块,所述使能信号控制块被配置为以所述第二时钟为参考将第二使能信号置于活动状态达与预定数目相等的时钟数,并将所述第二使能信号置于不活动状态达由所述计数块计数得出的时钟数;
使能信号输出块,所述使能信号输出块被配置为输出所述第二使能信号;以及
数据输出块,所述数据输出块被配置为在所述第二使能信号活动的区间中与所述第二时钟相同步地输出所述预定数目的数据项目。
2.根据权利要求1所述的信号处理装置,还包括:
时钟转换块,所述时钟转换块被配置为对具有预定频率的参考时钟进行频率转换以生成所述第二时钟,其中
所述时钟转换块通过使用使得所述第二时钟变得比所述第一时钟快的转换规则来生成所述第二时钟。
3.根据权利要求2所述的信号处理装置,其中所述信号处理装置包括:
第一信号处理模块;和
第二信号处理模块,该第二信号处理模块经由预定的信号线与所述第一信号处理模块连接;
所述第一信号处理模块具有
所述输入块,
所述计数块,和
传输块,所述传输块被配置为使所述数据和由所述计数块计数得出的时钟数串行化,并将已串行化的数据和已串行化的时钟数传送给所述第二信号处理模块,并且
所述第二信号处理模块具有
接收块,所述接收块被配置为接收来自所述第一信号处理模块的所述传输块的所述已串行化的数据和所述已串行化的时钟数,并使接收的已串行化的数据和已串行化的时钟数并行,
所述使能信号控制块,
所述数据输出块,和
所述使能信号输出块。
4.根据权利要求3所述的信号处理装置,其中,替代传送由所述计数块计数得出的所述时钟数,所述传输块传送所述第一时钟被用作参考时所述第一使能信号不活动的区间的时钟数与所述第二时钟被用作参考时所述第一使能信号不活动的区间的时钟数之间的差。
5.根据权利要求3所述的信号处理装置,其中,替代传送由所述计数块计数得出的所述时钟数,所述传输块传送预定值与所述第二时钟被用作参考时所述第一使能信号不活动的区间的时钟数之间的差。
6.根据权利要求3所述的信号处理装置,其中
所述第一信号处理模块还具有
串行传输时钟生成块,所述串行传输时钟生成块被配置为对预定参考时钟进行倍频以生成用于传送和接收所述数据和所述时钟数的串行传输时钟,以及
分频器,所述分频器被配置为对所述串行传输时钟进行分频以生成所述第二时钟,并且
所述第二信号处理模块还具有
分频器,所述分频器被配置为对所述串行传输时钟进行分频以生成所述第二时钟。
7.根据权利要求1所述的信号处理装置,其中所述计数块对通过将所述第一使能信号活动的区间和跟随在所述区间之后的所述第一使能信号不活动的区间相组合获得的区间的时钟数进行计数,从而使用通过从所述时钟数中减去所述预定值获得的值来作为所述第一使能信号不活动的区间的时钟数。
8.根据权利要求1所述的信号处理装置,其中所述数据是用于显示的数据,所述信号处理装置还包括:
计算处理块,所述计算处理块被配置为输出被输入所述输入块的数据;以及
显示块,所述显示块被配置为接收从所述输出块输出的所述数据以及从所述使能信号输出块输出的所述第二使能信号。
9.一种信号处理方法,包括:
接收预定数目的数据项目和第一使能信号,所述第一使能信号与第一时钟相同步并且在所述数据有效的区间中处于活动状态;
以比所述第一时钟快的第二时钟为参考对所述第一使能信号不活动的区间中的时钟数进行计数;
以所述第二时钟为参考将第二使能信号置于活动状态达与预定数目相等的时钟数,并且将所述第二使能信号置于不活动状态达在所述计数步骤中计数得出的时钟数;
输出所述第二使能信号;以及
在所述第二使能信号活动的区间中与所述第二时钟相同步地输出所述预定数目的数据项目。
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