[发明专利]PLL频率合成器无效
申请号: | 201180003895.9 | 申请日: | 2011-04-11 |
公开(公告)号: | CN102523763A | 公开(公告)日: | 2012-06-27 |
发明(设计)人: | 山崎秀聪;大原淳史 | 申请(专利权)人: | 松下电器产业株式会社 |
主分类号: | H03L7/095 | 分类号: | H03L7/095;H03K5/26;H03L7/06;H03L7/085 |
代理公司: | 中科专利商标代理有限责任公司 11021 | 代理人: | 樊建中 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | pll 频率 合成器 | ||
1.一种PLL频率合成器,其特征在于,具备:
振荡器,其以与数字控制码对应的振荡频率进行振荡;
计数器部,其对基于上述振荡器的输出信号而生成的振荡信号的波数进行计数并输出其计数值;
第1锁存部,其用基准信号对上述计数值进行锁存,并将其值作为第1振荡信号相位信息而输出;
振荡信号相位信息推断部,其推断上述第1锁存部的输出值,并将其作为第2振荡信号相位信息而输出;
数字相位检测器,其将上述基准信号与上述振荡信号之间的相位差值作为数字值而输出;
第2锁存部,其用上述基准信号对上述相位差值进行锁存,并将其值作为相位差信息而输出;
选择部,其根据锁定检测信号,将输出信号从上述第1振荡信号相位信息切换为上述第2振荡信号相位信息;
第3锁存部,其用上述基准信号对上述选择部的输出进行锁存,并将其值作为第3振荡信号相位信息而输出;
累积加法器,其按照上述基准信号的规定数量的周期,对用于设定上述振荡器的振荡频率的频率控制字进行累积加法运算,并将其值作为基准相位信息而输出;
相位比较器,其根据上述基准相位信息、上述相位差信息与上述第3振荡信号相位信息来计算出相位误差,并输出相位误差信号;和
振荡频率控制部,其被赋予上述相位比较器的输出信号,输出上述数字控制码。
2.根据权利要求1所述的PLL频率合成器,其特征在于,
还具备介于上述相位比较器与上述振荡频率控制部之间的数字环路滤波器。
3.根据权利要求1所述的PLL频率合成器,其特征在于,
上述振荡信号相位信息推断部,根据上述第2锁存部的本次的输出值与上述基准信号的规定数量的周期前的前次的输出值之差即相位差变化量、上述频率控制字的整数部的值、上述频率控制字的小数部的值、和上述第3锁存部的输出,生成上述第2振荡信号相位信息。
4.根据权利要求1所述的PLL频率合成器,其特征在于,
上述计数器部具备停止计数器动作的功能。
5.根据权利要求4所述的PLL频率合成器,其特征在于,
在上述选择部进入选择上述第2振荡信号相位信息的模式的情况下,上述计数器部始终或者间歇地停止计数器动作。
6.根据权利要求1所述的PLL频率合成器,其特征在于,
在上述第1振荡信号相位信息的变动收敛于规定的范围内的情况下,判断为稳定状态。
7.根据权利要求1所述的PLL频率合成器,其特征在于,
还具备锁存判断电路,其基于上述第1锁存部的输出值,判断上述振荡信号相位信息推断部中的推断是否正确。
8.根据权利要求1所述的PLL频率合成器,其特征在于,
根据上述锁存判断电路的判断结果来切换上述锁定检测信号。
9.一种PLL频率合成器,其特征在于,具备:
振荡器,其以与数字控制码对应的振荡频率进行振荡;
计数器部,其对基于上述振荡器的输出信号而生成的振荡信号的波数进行计数并输出其计数值;
第1锁存部,其使用第1时钟信号并用基准信号对上述计数值进行锁存,并将其值作为第1振荡信号相位信息而输出;
数字相位检测器,其将上述基准信号与上述振荡信号之间的相位差值作为数字值而输出;
第2锁存部,其用上述基准信号对上述相位差值进行锁存,并将其值作为相位差信息而输出;
第3锁存部,其使用第2时钟信号对上述计数值进行锁存,将使用上述第1时钟信号并用上述基准信号对上述锁存的值进行锁存而得到的值作为第2振荡信号相位信息而输出;
选择部,其根据上述相位差信息,从对上述第1振荡信号相位信息、上述第2振荡信号相位信息、上述第2振荡信号相位信息加上规定值而得到的值之中选择任一个,并将该值作为第3振荡信号相位信息而输出;
累积加法器,其按照上述基准信号的每规定量的周期,对用于设定上述振荡器的振荡频率的频率控制字进行累积加法运算,将其值作为基准相位信息而输出;
相位比较器,其根据上述基准相位信息、上述相位差信息与上述第3振荡信号相位信息计算出相位误差,并输出相位误差信号;和
振荡频率控制部,其被赋予上述相位比较器的输出信号,输出上述数字控制码。
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