[发明专利]薄膜半导体器件及其制造方法无效

专利信息
申请号: 201180004242.2 申请日: 2011-10-28
公开(公告)号: CN103189990A 公开(公告)日: 2013-07-03
发明(设计)人: 林宏;川岛孝启;河内玄士朗 申请(专利权)人: 松下电器产业株式会社;松下液晶显示器株式会社
主分类号: H01L29/786 分类号: H01L29/786;H01L21/336
代理公司: 北京市中咨律师事务所 11247 代理人: 段承恩;徐健
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 薄膜 半导体器件 及其 制造 方法
【说明书】:

技术领域

本发明涉及薄膜半导体器件及其制造方法,特别涉及沟道保护型的薄膜晶体管及其制造方法。

背景技术

近年来,作为替代液晶显示器的下一代平板显示器之一的利用了有机材料的EL(Electro Luminescence:电致发光)的有机EL显示器受到注目。在有机EL显示器等有源矩阵方式的显示装置中,使用被称为薄膜晶体管(TFT:Thin Film Transistor)的薄膜半导体器件。

特别地,有机EL显示器与电压驱动型的液晶显示器不同,是电流驱动型的显示器设备,急待开发作为有源矩阵方式的显示装置的驱动电路而具有优异的导通截止特性的薄膜晶体管。薄膜晶体管的构造,通常在基板上形成栅电极、半导体层(沟道层)、源电极以及漏电极,沟道层使用硅薄膜。

另外,显示器设备要求大画面化以及低成本化,作为可易于低成本化的薄膜晶体管,通常使用在相对于沟道层的基板侧形成有栅电极的底栅型的薄膜晶体管。

底栅型的薄膜晶体管大致分为沟道层被蚀刻的沟道蚀刻型的薄膜晶体管、和保护沟道层避免被蚀刻处理的沟道保护型(蚀刻阻止型)的薄膜晶体管这两类。

沟道蚀刻型的薄膜晶体管,与沟道保护型的薄膜晶体管相比,具有能够削减光刻工序数、抑制制造成本这样的优点。

另一方面,沟道保护型的薄膜晶体管能够防止蚀刻处理对沟道层造成损坏,能够抑制基板面内的特性不均。另外,沟道保护型的薄膜晶体管能够使沟道层薄膜化,能够降低寄生电阻成分并提高导通特性,因此在高精细化方面有利。

因此,沟道保护型的薄膜晶体管适于例如使用有机EL元件的电流驱动型的有机EL显示装置中的驱动晶体管,即使与沟道蚀刻型的薄膜晶体管相比而制造成本增加,也尝试将其用于有机EL显示装置的像素电路。

例如,专利文献1中公开了以微晶半导体薄膜为沟道层的沟道保护型的TFT,记载了在沟道层上隔着缓冲层形成沟道保护层的情况。

现有技术文献

专利文献1:日本特开2009-76894号公报

发明内容

发明要解决的问题

然而,在沟道保护型的薄膜晶体管中,在沟道保护层存在正的固定电荷,因此由于该固定电荷而在沟道层形成背沟道(back channel),其结果,存在泄漏电流(leak current)增大、薄膜晶体管的截止特性恶化这样的问题。特别地,当通过涂敷有机材料来形成沟道保护层时,与无机材料的沟道保护层相比,在沟道保护层含有更多正的固定电荷,因此,泄漏电流进一步增大,截止特性更加恶化。

另外,在沟道保护型的薄膜晶体管中,由于包含于沟道保护层的杂质,在沟道保护层内存在陷阱能级(trap level),因此,由于该陷阱能级使得载流子容易被俘获(trap),其结果,也存在薄膜晶体管的阈值电压漂移、薄膜晶体管的可靠性恶化这样的问题。特别地,由涂敷型的有机材料构成的沟道保护层,与无机材料的沟道保护层相比,在沟道保护层内存在更多陷阱能级,因此,阈值电压的漂移量变大,薄膜晶体管的可靠性更加恶化。

本发明是为了解决这样的问题而完成的发明,其目的在于,对沟道保护型的薄膜晶体管,提供一种截止特性以及可靠性优异的薄膜半导体器件及其制造方法。

用于解决问题的手段

为了达到上述目的,本发明的一个方式的薄膜半导体器件的制造方法,其特征在于,包括:第一工序,准备基板;第二工序,在所述基板上形成栅电极;第三工序,在所述栅电极上形成第一绝缘膜;第四工序,在所述第一绝缘膜上形成成为沟道层的半导体薄膜;第五工序,在所述半导体薄膜上形成第二绝缘膜;第六工序,通过对所述第二绝缘膜照射光线,提高所述第二绝缘膜的透射率;以及第七工序,在所述沟道层的上方形成源电极以及漏电极。

另外,本发明的一个方式的薄膜半导体器件,其特征在于,具备:基板;栅电极,其形成于所述基板上;第一绝缘膜,其形成于所述栅电极上;结晶半导体薄膜,其形成于所述第一绝缘膜上;源电极以及漏电极,其形成于所述结晶半导体薄膜的上方;以及第二绝缘膜,其形成于所述结晶半导体薄膜上;所述第二绝缘膜通过对该第二绝缘膜的前驱体照射所述光线而形成,所述第二绝缘膜对所述光线的透射率,在照射所述光线后比照射所述光线前高。

发明的效果

根据本发明,能够实现截止特性以及可靠性优异的薄膜半导体器件。

附图说明

图1是表示本发明的第一实施方式的薄膜半导体器件的结构的剖面图。

图2是用于说明本发明的第一实施方式的薄膜半导体器件的制造方法的剖面图。

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