[发明专利]存储器中的参考单元写入操作无效

专利信息
申请号: 201180015331.7 申请日: 2011-03-25
公开(公告)号: CN102822898A 公开(公告)日: 2012-12-12
发明(设计)人: 金正丕;哈利·M·拉奥;李霞 申请(专利权)人: 高通股份有限公司
主分类号: G11C8/10 分类号: G11C8/10;G11C11/16;G11C13/00
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 宋献涛
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 存储器 中的 参考 单元 写入 操作
【说明书】:

技术领域

发明大体涉及存储器处的参考单元写入操作。

背景技术

技术的进步已产生更小且功能更强大的计算装置。举例来说,当前存在小型、重量轻且易于由用户携带的多种便携式个人计算装置,例如个人数字助理(PDA)、无线电话和寻呼装置。便携式无线电话(例如,蜂窝式电话和因特网协议(IP)电话)可经由无线网络传送语音和数据包。此外,许多此类无线电话包含并入其中的其它类型装置。举例来说,无线电话还可包含数字静态相机、数字摄像机、数字记录器和音频文件播放器。此类无线电话可执行软件应用程序(例如,网络浏览器应用程序)的指令以接入因特网。因此,无线电话可包含显著的计算能力。

上文提及的便携式个人计算装置包含用于存储与特定装置的使用和操作相关的数据的存储器。例如自旋力矩转移磁性随机存取存储器(STT-MRAM)等基于电阻的存储器提供高密度高速度长期非易失性数据存储。针对基于电阻的存储器的每一参考单元进行参考单元的写入可能是耗时的工作,且可能需要专用参考单元写入命令。专用外部参考单元写入命令可增加系统的成本。

发明内容

本发明的实施例提供一种与在基于电阻的存储器的存储器单元处写入数据值同时地在所述基于电阻的存储器的参考单元处写入数据值的设备和方法。参考单元中的每一者可基于行解码电路的输出和列解码电路的输出而经选择以用于写入操作,因此使得能够与数据单元的编程同时以及响应于数据单元的编程而对参考单元进行编程。因此,可以较便利的方式实现参考单元的编程。

在一特定实施例中,揭示一种非易失性存储器。所述非易失性存储器包括多个存储器单元。所述非易失性存储器还包括用以将逻辑1值写入到第一参考单元的第一写入电路和用以将逻辑0值写入到第二参考单元的第二写入电路。所述非易失性存储器还包括列解码电路和行解码电路。参考单元中的每一者可基于行解码电路和列解码电路的输出而经选择以用于写入操作。

在另一特定实施例中,揭示一种非易失性存储器。所述非易失性存储器包括存储器阵列,所述存储器阵列包括多个存储器单元和参考线。参考线中的至少一者与参考单元相关联,所述参考单元可响应于接收到写入命令且在不需要专用参考单元写入命令的情况下与存储器阵列中的所述多个存储器单元中的一者的写入操作同时地编程。

在另一特定实施例中,揭示一种非易失性存储器。所述非易失性存储器包括多个存储器单元。所述多个存储器单元中的每一者包括基于电阻的存储器元件。所述非易失性存储器包括用以将逻辑1值写入到第一参考单元的第一写入电路。第一参考单元包括第一基于电阻的存储器元件。所述非易失性存储器包括用以将逻辑0值写入到第二参考单元的第二写入电路。第二参考单元包括第二基于电阻的存储器元件。所述非易失性存储器还包括列解码电路和行解码电路。参考单元中的每一者可基于行解码电路的第一输出和列解码电路的第二输出而经选择以用于写入操作。每一参考单元可响应于接收到写入命令且在不需要专用参考单元写入命令的情况下与所述多个存储器单元中的一者的写入操作同时地编程。

在另一特定实施例中,揭示一种方法。所述方法包括基于行解码器电路的第一输出和列解码电路的第二输出而选择用于写入操作的参考电路。所述方法进一步包括响应于接收到写入命令且在不需要专用参考电路写入命令的情况下与存储器阵列中的多个存储器单元中的至少一者的写入操作同时地对所述参考电路进行编程。

所揭示的实施例中的至少一者所提供的一个特定优点是,可通过在不需要专用参考单元写入命令的情况下在基于电阻的存储器(例如,STT-MRAM单元)的参考单元处可靠地写入数据值来改进基于电阻的存储器装置的性能。由于不需要专用参考单元写入命令来对参考单元进行编程,所以可以较方便的方式实现参考单元的编程。

附图说明

图1是具有参考单元且具有列解码电路的基于电阻的存储器电路的说明性实施例的框图;

图2是包含经配置以将存储器单元的数据值与参考电路的参考数据值进行比较的读出放大器的基于电阻的存储器电路的说明性实施例的电路图;

图3是选择用于写入操作的参考电路的方法的第一说明性实施例的流程图;

图4是选择用于写入操作的参考电路的方法的第二说明性实施例的流程图;

图5是具有参考单元且具有列解码电路的基于电阻的存储器电路的存储器布局的特定说明性实施例的框图;

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