[发明专利]浮点缩放处理器、方法、系统和指令有效

专利信息
申请号: 201180076106.4 申请日: 2011-12-28
公开(公告)号: CN104040484B 公开(公告)日: 2018-06-19
发明(设计)人: C·S·安德森;A·格雷德斯廷;R·凡伦天;S·卢巴诺维奇;B·艾坦 申请(专利权)人: 英特尔公司
主分类号: G06F9/06 分类号: G06F9/06;G06F9/30;G06F13/14
代理公司: 上海专利商标事务所有限公司 31100 代理人: 何焜
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 浮点数据 浮点 缩放 指令 缩放处理器 结果存储 整数次幂 指令指示 基数 响应
【权利要求书】:

1.一种用于执行指令的方法,包括:

接收浮点缩放指令,所述浮点缩放指令指示包括一个或多个不必具有整数值的浮点数据元素的第一源,指示包括一个或多个相应浮点数据元素的第二源,并且指示目的地;以及

响应于所述浮点缩放指令将结果存储在所述目的地中,所述结果包括一个或多个结果浮点数据元素,所述一个或多个结果浮点数据元素具有和所述第二源的所述一个或多个浮点数据元素相同的浮点格式,所述一个或多个结果浮点数据元素中的每一个都包括第二源的相应浮点数据元素乘以基数的代表第一源的相应浮点数据元素的整数次幂。

2.如权利要求1所述的方法,其特征在于,还包括响应于所述浮点缩放指令来确定代表第一源的一个或多个相应浮点数据元素的一个或多个整数。

3.如权利要求2所述的方法,其特征在于,确定一个或多个整数包括确定选自以下的整数:(1)小于或等于第一源的相应浮点数据元素的最大整数;以及(2)大于或等于第一源的相应浮点数据元素的最小整数。

4.如权利要求1所述的方法,其特征在于,所述第一和第二源中的每一者都包括多个打包浮点数据元素,并且其中所述结果包括相同的多个打包结果浮点数据元素。

5.如权利要求1所述的方法,其特征在于,接收包括接收指示第一源的浮点缩放指令,第一源包括为非数(NaN)、正无穷大、负无穷大、以及非规格化数之一的浮点数据元素。

6.如权利要求1所述的方法,其特征在于,接收包括接收指示含有为非数(NaN)的浮点数据元素的第二源的浮点缩放指令,并且其中存储包括存储含有也为非数(NaN)的相应结果浮点数据元素的结果。

7.如权利要求1所述的方法,其特征在于,接收包括接收进一步指示第三组一个或多个相应浮点数据元素的所述浮点缩放指令,并且其中存储包括存储含有一个或多个结果浮点数据元素的结果,每个结果浮点数据元素都包括第二源的相应浮点数据元素乘以基数的代表第一源的相应浮点数据元素的整数次幂加上第三组的相应浮点数据元素。

8.如权利要求1所述的方法,其特征在于,接收包括接收指示第一源的浮点缩放指令,第一源包括以下之一:(1)至少八个双精度浮点数据元素;以及(2)至少十六个单精度浮点数据元素。

9.如权利要求1所述的方法,其中所述基数是2。

10.如权利要求1所述的方法,其特征在于,接收包括接收指示含有单个浮点数据元素的第一源和指示含有多个打包浮点数据元素的第二源的浮点缩放指令,并且其中存储包括存储含有多个打包结果浮点数据元素的结果,每个打包结果浮点数据元素对应于第二源的所述多个打包浮点数据元素之一,所述多个打包结果浮点数据元素中的每一个都包括第二源的相应浮点数据元素乘以基数的代表第一源的所述单个浮点数据元素的整数次幂。

11.如权利要求1所述的方法,其特征在于,接收包括接收进一步指示打包数据操作掩码的浮点缩放指令,并且其中存储结果包括根据所述打包数据操作掩码在结果中有条件地存储经缩放的浮点数据元素。

12.一种计算装置,包括:

多个寄存器,用于存储由浮点缩放指令所指示的第一源、第二源、以及目的地,所述第一源用于包括一个或多个不必具有整数值的浮点数据元素,所述第二源用于包括一个或多个相应浮点数据元素;以及

与所述多个寄存器耦合的浮点执行单元,所述浮点执行单元用于响应于所述浮点缩放指令而去将结果存储在所述目的地中,所述结果将包括一个或多个结果浮点数据元素,所述一个或多个结果浮点数据元素具有和所述第二源的所述一个或多个浮点数据元素相同的数据元素尺寸,所述一个或多个结果浮点数据元素中的每一个都将包括第二源的相应浮点数据元素乘以基数的代表第一源的相应浮点数据元素的整数次幂。

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