[发明专利]与非型闪存Nandflash控制器在审

专利信息
申请号: 201210021836.0 申请日: 2012-01-31
公开(公告)号: CN103226530A 公开(公告)日: 2013-07-31
发明(设计)人: 迟志刚 申请(专利权)人: 上海华虹集成电路有限责任公司
主分类号: G06F13/28 分类号: G06F13/28;G06F12/06
代理公司: 上海浦一知识产权代理有限公司 31211 代理人: 戴广志
地址: 201203 上海*** 国省代码: 上海;31
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摘要:
搜索关键词: 闪存 nandflash 控制器
【权利要求书】:

1.一种与非型闪存Nandflash控制器,其特征在于,包括:

一设备接口控制器,用于以某种协议和主控端进行数据传输;

一设备端直接存储器访问DMA控制器,与微控制器和所述设备接口控制器相连接,用于控制所述设备接口控制器和系统存储器之间的数据传输;

一系统存储器,用于暂存所述设备接口控制器和与非型闪存直接存储器访问Nandflash DMA控制器之间传输的数据,及用于存放当前数据读写所使用的地址映射表;

一系统存储器访问仲裁逻辑模块,与与非型闪存直接存储器访问Nandflash DMA控制器、所述微控制器、设备端直接存储器访问DMA控制器和系统存储器相连接,用于仲裁微控制器、设备接口控制器和与非型闪存直接存储器访问Nandflash DMA控制器对所述系统存储器的访问请求;

一排序链表更新逻辑模块,与所述微控制器相连接,用于对与非型闪存Nandflash的物理块按擦写次数进行动态排序;

一排序链表存储器,与所述排序链表更新逻辑模块相连接,用于存放对与非型闪存Nandflash的物理块按擦写次数进行排序的排序链表;

一与非型闪存直接存储器访问Nandflash DMA控制器,与所述微控制器相连接,用于控制所述系统存储器与与非型闪存Nandflash数据缓存区之间的数据传输;

一与非型闪存Nandflash数据缓存区,与所述与非型闪存直接存储器访问Nandflash DMA控制器相连接,用于缓存从所述系统存储器读出但来不及写入与非型闪存Nandflash的数据,和从所述与非型闪存Nandflash读出但来不及写入所述系统存储器的数据;

一与非型闪存Nandflash接口控制器,与所述与非型闪存Nandflash数据缓存区相连接,用于控制与非型闪存Nandflash数据缓存区和与非型闪存Nandflash之间的数据传输;

一微控制器,用于控制设备端直接存储器访问DMA控制器、系统存储器访问仲裁逻辑模块、与非型闪存直接存储器访问Nandflash DMA控制器和排序链表更新逻辑模块。

2.如权利要求1所述的与非型闪存Nandflash控制器,其特征在于:所述排序表采用链表结构;每一物理块均有对应的链表项,每一链表项包含两个指针,一个指针指向当前物理块的前一个物理块,另一个指针指向当前物理块的后一个物理块。

3.如权利要求1所述的与非型闪存Nandflash控制器,其特征在于:所述与非型闪存Nandflash的物理块被擦写完成时,将该物理块的擦写次数加1并通知排序链表更新逻辑模块更新排序链表。

4.如权利要求3所述的与非型闪存Nandflash控制器,其特征在于:所述排序链表的更新是指,当完成对与非型闪存Nandflash中的一个物理块的内容擦写后,将被擦写的物理块和其擦写次数写入排序链表更新逻辑模块中的寄存器。

5.如权利要求1-4任一所述的与非型闪存Nandflash控制器,其特征在于:所述排序链表更新逻辑模块,将被擦写的物理块从排序链表中删除,删除操作是将被檫写物理块的前一物理块和后一物理块链接起来;将被擦写的物理块插入排序链表中的新位置,排序链表更新逻辑模块从被擦写物理块开始向前查找,直到查找到该被擦写物理块的擦写次数大于或者等于排序链表中某个擦写次数对应的物理块,将被擦写物理块插入到该物理块之后。

6.如权利要求1所述的与非型闪存Nandflash控制器,其特征在于:在系统上电时,将对与非型闪存Nandflash的物理块按擦写次数进行排序的排序链表从与非型闪存Nandflash中读出,写入所述排序链表存储器;

系统停止工作时,将对与非型闪存Nandflash的物理块按擦写次数进行排序的排序链表,从所述排序链表存储器写回与非型闪存Nandflash中。

7.如权利要求1所述的与非型闪存Nandflash控制器,其特征在于:在使用与非型闪存Nandflash之前,对所述排序链表进行初始化,将与非型闪存Nandflash的物理块的擦写次数全部设为零,从链表头到链表尾依次为物理块N,N-1,N-2,…,3,2,1,并写入与非型闪存Nandflash中约定的位置;其中,N为与非型闪存Nandflash中物理块的总数,排序链表头初始指向物理块N,排序链表尾初始指向物理块0。

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