[发明专利]一种改善双大马士革工艺中KINK缺陷的方法无效
申请号: | 201210343445.0 | 申请日: | 2012-09-17 |
公开(公告)号: | CN102881639A | 公开(公告)日: | 2013-01-16 |
发明(设计)人: | 黄君;张瑜;盖晨光 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768 |
代理公司: | 上海申新律师事务所 31272 | 代理人: | 竺路玲 |
地址: | 201210 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 改善 大马士革 工艺 kink 缺陷 方法 | ||
1.一种改善双大马士革工艺中KINK缺陷的方法,其特征在于,包括以下步骤:
步骤S1:沉积超低介电常数介电质层覆盖一制备有底部金属的半导体结构的上表面后,再沉积一低电常数介电质层覆盖所述超低介电常数介电质层的上表面;
步骤S2:从下至上顺便依次沉积金属硬质掩膜层和垫氧化物层覆盖所述低介电常数介电质层的上表面;
步骤S3:打开所述金属硬质掩膜后,采用光刻、刻蚀工艺于所述超低介电常数介电质层中形成通孔结构;
步骤S4:采用沟槽刻蚀工艺形成沟槽,并贯通所述通孔结构的底部至所述底部金属中,形成通孔后,去除所述低介电常数介电质层。
2.根据权利要求1所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述半导体结构还包括底部介质层和停止层,所述底部金属贯穿所述底部介质层,所述停止层覆盖所述底部金属和所述底部介质层的上表面,所述超低介电常数介电质层覆盖所述停止层的上表面。
3.根据权利要求1或2所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述金属硬质掩膜层包括第一氧化物层、金属层和第二氧化物层,所述第一氧化物层覆盖所述超低介电常数介电质层的上表面,所述金属层覆盖所述第一氧化物的上表面,所述第二氧化物层覆盖所述金属层的上表面。
4.根据权利要求3所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述金属层的材质为TiN。
5.根据权利要求3所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述步骤S3中采用光刻、刻蚀工艺,依次回蚀所述垫氧化物层、所述第二氧化物层和所述金属层至所述第一氧化物层中,打开所述金属硬质掩膜,形成沟槽结构。
6.根据权利要求3所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述停止层的厚度为400A、所述超低介电常数介电质层的厚度为2500-2800A,所述第一氧化物层的厚度为300-400A,所述金属层的厚度为50-150A,所述第二氧化物层的厚度为200-300A,所述垫氧化物层的厚度为50A。
7.根据权利要求3所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述第一氧化物层和所述第二氧化物层的材质均为SiON。
8.根据权利要求3所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述低介电常数介电质层的厚度为200-300A。
9.根据权利要求3所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述低介电常数介电质层的介电常数为2.7-3.0。
10.根据权利要求3所述的改善双大马士革工艺中KINK缺陷的方法,其特征在于,所述超低介电常数介电质层的介电常数为2.4-2.6。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造