[发明专利]半导体器件和系统、命令地址建立/保持时间控制方法有效
申请号: | 201210399145.4 | 申请日: | 2012-10-19 |
公开(公告)号: | CN103198859B | 公开(公告)日: | 2017-07-21 |
发明(设计)人: | 高福林 | 申请(专利权)人: | 爱思开海力士有限公司 |
主分类号: | G11C11/408 | 分类号: | G11C11/408;G11C11/415;G11C11/4195 |
代理公司: | 北京弘权知识产权代理事务所(普通合伙)11363 | 代理人: | 周晓雨,俞波 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 半导体器件 系统 命令 地址 建立 保持 时间 控制 方法 | ||
相关申请的交叉引用
本申请要求2012年1月5日向韩国知识产权局提交的申请号为10-2012-0001714的韩国专利申请的优先权,其全部内容通过引用合并于此。
背景技术
一般而言,可以将命令/地址信号从控制器施加到诸如半导体存储器件的半导体器件,命令/地址信号需要满足建立/保持时间规范。随着控制器操作速度的增加,正在研究用于命令/地址信号的各种方法以满足建立/保持时间规范。
通过在控制器将命令地址施加到半导体器件的同时检查产生的命令/地址信号的延迟量,控制器执行控制命令/地址信号的建立/保持时间的操作(在下文中,称作“校准操作”)。半导体器件锁存命令/地址信号并经由数据焊盘输出锁存的命令/地址信号,控制器被反馈经由数据焊盘输出的命令地址。
然而,在命令/地址信号的数目大于数据焊盘的数目的情况下,半导体器件不能将命令/地址信号输出到数据焊盘。因此,由于控制器不能被反馈命令/地址信号,因此不能控制控制命令地址的建立/保持时间。
发明内容
本发明的一个实施例涉及一种半导体系统,所述半导体系统分开地锁存命令/地址信号,由此即使在命令/地址信号的数目大于数据焊盘的数目的情况下也可以控制命令/地址信号的建立/保持时间。
在本发明的一个实施例中,一种半导体系统包括:控制器,所述控制器被配置成施加时钟使能信号、第一命令地址至第三命令地址、芯片选择信号、第一进入命令和第二进入命令以及退出命令,并接收输出信号;以及半导体器件,所述半导体器件被配置成响应于芯片选择信号和第一进入命令而锁存第一命令地址和第二命令地址并传送输出信号,响应于芯片选择信号和第二进入命令而锁存第一命令地址和第三命令地址并传送输出信号,以及响应于时钟使能信号和退出命令信号而传送由第一命令地址至第三命令地址产生的数据作为输出信号。
在本发明的一个实施例中,一种半导体系统包括:信号发生块,所述信号发生块被配置成响应于内部时钟、时钟使能信号、芯片选择信号、第一进入命令和第二进入命令以及退出命令而产生选通信号、第一校准信号和第二校准信号以及控制信号;锁存块,所述锁存块被配置成响应于选通信号而锁存第一命令地址,并且产生第一锁存命令地址;选择性锁存块,所述选择性锁存块被配置成响应于选通信号以及第一校准信号和第二校准信号而锁存第二命令地址或第三命令地址,并且产生选择性锁存命令地址;读取路径电路,所述读取路径电路被配置成被输入第一命令地址至第三命令地址并产生数据;以及多路复用器,所述多路复用器被配置成响应于控制信号而传送数据、或第一锁存命令地址和选择性锁存命令地址作为输出信号。
在本发明的一个实施例中,一种用于控制命令地址的建立/保持时间的方法包括以下步骤:通过控制器将第一命令地址至第三命令地址、第一进入命令、时钟使能信号以及芯片选择信号施加到半导体器件;产生通过在时钟使能信号被禁止且芯片选择信号被使能的时段期间锁存第一命令地址和第二命令地址而产生的第一锁存命令地址和第二锁存命令地址,并通过半导体器件将第一锁存命令地址和第二锁存命令地址传送到控制器;通过控制器将第一命令地址至第三命令地址、第二进入命令、时钟使能信号以及芯片选择信号施加到半导体器件;产生通过在时钟使能信号被禁止且芯片选择信号被使能的时段期间锁存第一命令地址和第三命令地址而产生的第一锁存命令地址和第三锁存命令地址,并通过半导体器件将第一锁存命令地址和第三锁存命令地址传送到控制器;以及通过控制器来控制第一锁存命令地址至第三锁存命令地址的建立/保持时间。
在根据本发明实施例的半导体器件中,即使在命令地址的数目大于数据焊盘的数据的情况下,也可以控制命令地址的建立/保持时间。
附图说明
从如下结合附图的详细描述中将更加清楚地理解以上和其他的方面、特征和其他优点,其中:
图1是示出根据本发明一个实施例的半导体系统的配置的框图;
图2是示出图1所示的半导体系统中所包括的半导体器件的配置的框图;
图3是示出图2所示的半导体器件中所包括的信号发生块的配置的框图;
图4是示出图3所示的信号发生块中所包括的校准信号发生单元的配置的电路图;
图5是示出图3所示的信号发生块中所包括的选通信号发生单元的配置的电路图;
图6是示出图3所示的信号发生块中所包括的控制信号发生单元的配置的电路图;
图7是示出图2所示的半导体器件中所包括的锁存块的配置的电路图;
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