[发明专利]一种移位寄存器单元、栅极驱动电路和显示装置有效

专利信息
申请号: 201210540296.7 申请日: 2012-12-13
公开(公告)号: CN103065578A 公开(公告)日: 2013-04-24
发明(设计)人: 孔益;刘俊豪 申请(专利权)人: 京东方科技集团股份有限公司;合肥京东方光电科技有限公司
主分类号: G09G3/20 分类号: G09G3/20;G09G3/36;G11C19/28
代理公司: 北京同达信恒知识产权代理有限公司 11291 代理人: 黄志华
地址: 100015 *** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 移位寄存器 单元 栅极 驱动 电路 显示装置
【说明书】:

技术领域

发明涉及平板显示技术领域,尤其涉及一种移位寄存器单元、栅极驱动电路和显示装置。

背景技术

平板显示器,因其超薄节能而发展迅速。多数平板显示器中要用到移位寄存器,目前,通过阵列基板行驱动(Gate on Array,GOA)技术实现的移位寄存器不但能够集成在栅极驱动集成电路上,还能减少一道显示面板的制作工序,因此,节约成本,所以近几年来,GOA技术被广泛应用于平板显示器制造工艺中。

在目前的GOA设计方案中,该栅极驱动电路的结构示意图可以如图1所示,其包含的移位寄存器单元可以为如图2所示的电路,其包括上拉控制模块101、上拉模块102、复位控制模块103和复位模块104,具体地,上拉控制模块包括第一晶体管M1,上拉模块102包括第三晶体管M3和第一电容C1,复位控制模块103包括第五晶体管M5、第六晶体管M6、第八晶体管M8和第九晶体管M9,复位模块104包括第二晶体管M2、第四晶体管M4、第十晶体管M10、第十一晶体管M11、第十二晶体管M12和第十三晶体管M13,然而,由于第三晶体管M3的尺寸较大(沟道宽度为9000um),因此存在较大的寄生电容,此外,由于第一电容C1的耦合作用,以及连接在输出端OutPut的晶体管在开启和关闭时产生的漏电电流(晶体管有开启和关闭电压,但总会有部分载流子在关闭的时候仍在移动)使得OutPut端的输出如图3所示带有噪声(输出后的噪声(Noise after Output,Na)和输出前的噪声(Noise before Output,Nb))的波形,这将导致画面的不良显示。

发明内容

本发明实施例提供了一种移位寄存器单元、栅极驱动电路和显示装置,用以解决现有的移位寄存器单元输出的波形带有噪声,导致画面的不良显示的问题。

本发明实施例提供的具体技术方案如下:

一种移位寄存器单元,所述移位寄存器单元包括:

上拉控制模块,用于接收输入信号,并向上拉节点输出上拉控制信号;

上拉模块,用于根据上拉节点的上拉控制信号,将第一时钟信号输出端子输出的信号提供给第一输出端子;

复位模块,用于根据复位信号,向上拉节点和第一输出端子提供第一电源电压;

去噪模块,用于在第一输出端子输出的信号的电平值大于第一设定阈值时,保存该第一输出端子输出的信号,在去噪控制信号输出端子输出的信号的电平值大于第二设定阈值时,从第二输出端子输出保存的第一输出端子输出的信号。

一种栅极驱动电路,包括上述移位寄存器单元;其中,除第一个移位寄存器单元和最后一个移位寄存器单元外,其余每个移位寄存器单元的第一输出端子连接到与其相邻的上一级移位寄存器单元的复位信号输入端子和与其相邻的下一级移位寄存器单元的输入端子,栅极驱动电路顺序地输出各级移位寄存器单元的第二输出端子的输出信号;

第一个移位寄存器单元的第一输出端子与第二个移位寄存器单元的输入端子连接,最后一个移位寄存器单元的第一输出端子和与其相邻的上一个移位寄存器单元的复位信号输入端子以;

第一个移位寄存器单元的输入端子输入帧起始信号。

一种显示装置,所述显示装置包含上述的栅极驱动电路。

通过本发明的实施例,由于在移位寄存器单元中增加了去噪模块,该去噪模块在第一输出端子输出的信号的电平值大于第一设定阈值时,保存该第一输出端子输出的信号,在去噪控制信号输出端子输出的信号的电平值大于第二设定阈值时,从第二输出端子输出保存的第一输出端子输出的信号,因此达到了对第一输出端子输出的信号进行去除噪声的目的,使得输出给与第二输出端子相连的栅线的信号的噪声减小,因此,本发明的移位寄存器单元解决了由于输出信号的噪声而导致画面显示不良的问题。

附图说明

图1为背景技术中的栅极驱动电路的结构示意图;

图2为背景技术中的移位寄存器单元的电路图;

图3为背景技术中的移位寄存器单元输出信号的波形示意图;

图4为本发明实施例一中的移位寄存器单元的结构示意图;

图5为本发明实施例一中的移位寄存器单元的结构示意图;

图6为本发明实施例一中的移位寄存器单元的电路图;

图7为本发明实施例一中移位寄存器单元的工作时序意图;

图8为本发明实施例二中的移位寄存器单元的电路图;

图9为本发明实施例二中移位寄存器单元的工作时序意图;

图10为本发明实施例三中的栅极驱动电路的结构示意图;

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