[发明专利]连接的待机睡眠状态有效

专利信息
申请号: 201280065579.9 申请日: 2012-12-21
公开(公告)号: CN104024980B 公开(公告)日: 2016-11-16
发明(设计)人: J·哈杰-伊西亚 申请(专利权)人: 英特尔公司
主分类号: G06F1/32 分类号: G06F1/32;G06F13/14
代理公司: 上海专利商标事务所有限公司 31100 代理人: 张东梅
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 连接 待机 睡眠 状态
【权利要求书】:

1.一种平台系统,包括:

处于睡眠状态的处理器,所述处理器耦合到平台控制中枢、外部电压调节器和环境控制器;

由持续功率面供电的所述处理器中的组件,包括:

处理器上下文被存储在其中的高速缓存存储器,

用于处理处理器唤醒和上下文恢复的唤醒逻辑,

在所述处理器和所述平台控制中枢、外部电压调节器和环境控制器之间的I/O接口,以及

静电放电箝位;

其中,所述处理器在以下时机进入连接的待机睡眠状态:

经由所述I/O接口从所述唤醒逻辑接收到计时器信号;

选通所述处理器中操作的时钟;

借助于与所述持续功率面分离的专用功率面,为所述处理器上下文存储在其中的所述高速缓存存储器供电;

降低由所述持续功率面供电的剩余组件的功率,且降低所述持续功率面的功率;

把用于处理处理器唤醒和上下文恢复的唤醒源重定向到所述平台控制中枢;以及

把所述处理器的体系结构功能转移给所述平台控制中枢,包括时戳计数器的操作。

2.如权利要求1所述的平台系统,其特征在于,在所述平台控制中枢进行以下时,所述处理器退出所述连接的待机睡眠状态:

接收唤醒源;

增加所述持续功率面的功率;

断言保持功率良好信号;

借助于所述持续功率面给所述高速缓存存储器供电;以及

去选通所述时钟。

3.如权利要求1所述的平台系统,其特征在于,用于处理处理器唤醒和上下文恢复的所述唤醒源包括以下中的任何一个:

计时器事件;

平台环境控制接口唤醒信号;以及

所述平台控制中枢上发生的中断。

4.如权利要求3所述的平台系统,其特征在于,经由所述I/O接口从所述唤醒逻辑接收到的所述计时器信号是至下一事件的时间信号,且所述计时器事件是所述至下一事件的时间信号的到期。

5.如权利要求1所述的平台系统,其特征在于,在所述处理器和所述平台控制中枢之间的所述I/O接口支持所述参考时钟信号、用于PMSYNC和PM DOWN消息收发的双向串行接口、平台复位信号(PLTRST)、功率良好(PWRGOOD)信号和热断路信号(THERMTRIP)中的任何一种。

6.如权利要求1所述的平台系统,其特征在于,在所述处理器和所述外部电压调节器之间的所述I/O接口是串行电压标识(SVID)接口。

7.如权利要求1所述的平台系统,其特征在于,在所述处理器和所述环境控制器之间的所述I/O接口支持用于功率、热和错误管理(PECI)的串行接口。

8.如权利要求1所述的平台系统,其特征在于,所述I/O接口还支持调试信号,包括灾难性错误信号和测试访问端口信号。

9.一种用于在平台系统中有效地管理功率的方法,所述方法包括:

把存储处于深度睡眠状态的处理器的上下文的高速缓存存储器从持续功率面转移到专用功率面;

把用于所述处理器的唤醒源重定向到平台控制中枢,所述平台控制中枢通信上耦合到所述处理器;

降低所述持续功率面的功率,所述持续功率面给所述平台控制中枢和所述处理器中的不必处于所述深度睡眠状态的组件供电;

选通对所述处理器操作的参考时钟;以及

在所述平台控制中枢上等待用于所述处理器的唤醒源的到达。

10.如权利要求9所述的方法,进一步包括:

响应于所述唤醒源的到达,所述平台控制中枢使得所述处理器返回到前面的深度睡眠状态,包括:

提高所述持续功率面的功率;

使得存储处于所述深度睡眠状态的所述处理器的所述上下文的所述高速缓存存储器从所述专用功率面返回到所述持续功率面;以及

去选通所述处理器上的所述参考时钟。

11.如权利要求9所述的方法,其特征在于,不必处于所述深度睡眠状态的、由所述持续功率面供电的所述组件包括:

在所述处理器和所述平台控制中枢之间的接口;

在所述处理器和环境控制器之间的接口;以及

在所述处理器和外部电压调节器之间的接口。

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